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  1. 60counter

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  2. 60进制计数器,其功能是实现60进制计数的vhdl语言
  3. 所属分类:Linux/Unix编程

    • 发布日期:2008-10-13
    • 文件大小:1749
    • 提供者:史乐
  1. ctfysj

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  2. 3-8译码器,BCD码转换10进制,计数器-3-8 decoder, 10 BCD switch 229, counter, etc.
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:8192
    • 提供者:Gem
  1. 11223344scan_led1000

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  2. Quartus环境下的1000进制计数器的扫描显示电路-Quartus environment under the 1000 counter-band scanning display circuit
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:208896
    • 提供者:吴语
  1. simple_clock_VHDL

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  2. (1)具有时、分、秒计数显示功能,小时为24进制,分钟和秒为60进制。 (2)可以根据需要设置复位、清零、置位等功能。 -(1) with time, minutes and seconds count display, 229 hours for 24, 50 minutes and 60 seconds for the 229. (2) can be reset according to the need, resett
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:8192
    • 提供者:
  1. 60COUNTER

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  2. 六十进制计数器.电子万年历是计数器的应用之一.年由月的十二进制计数器进位+1得到.月是日的三十进制计数器进位+1得到.日是小时的二十四进制计数器进位+1得到.小时是分的六十进制计数器进位+1得到.分是秒的六十进制计数器进位+1得到.本程序基于VHDL.其开发环境是MAXPLUS2-Six decimal counter. Electronic calendar is one of counter application. 10 mont
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2024-06-11
    • 文件大小:4096
    • 提供者:weixiaoyu
  1. counter24

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  2. 24进制计数,可以执行异步复位。该文件包含整个项目-24 hexadecimal counting, can perform asynchronous reset. This document contains the entire project
  3. 所属分类:Windows编程

    • 发布日期:2024-06-11
    • 文件大小:180224
    • 提供者:iyoung
  1. jishu10

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  2. FPGA——1位10进制计数程序,可用原理图输入法拓展n位,下载后可直接使用,Q2中综合已通过,基于cyclone-FPGA- 1 station 10 hexadecimal counting procedures, schematics can be used to expand n-bit input, can be used directly after downloading, Q2 has passed comprehens
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:179200
    • 提供者:LiuYuan
  1. jianyishuzizhong

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  2. 一个简易的数字钟,能显示小时、分和秒,是一台按秒计数并显示的计时器,其中秒和分为60进制,小时为24进制计数。-A simple digital clock showing the hours, minutes and seconds, is one count per second and displays the timer, which is divided into 60 seconds, and decimal, hexade
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2024-06-11
    • 文件大小:10240
    • 提供者:刘逊
  1. gtt2

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  2. 十二位进制计数,0-999999999999, 计数技结束后输出总计数的七段码,采用动态扫描输出的方式-12 0-999999999999 band count, total count of technological output after the number of seven segment, dynamic scanning mode output
  3. 所属分类:压缩解压

    • 发布日期:2024-06-11
    • 文件大小:424960
    • 提供者:顾婷婷
  1. Counter24VHDL

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  2. 用VHDL语言实现24进制计数,具有清零、控制使能作用。-VHDL language with the binary count of 24, with clear control in enabled.
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:1024
    • 提供者:Successan
  1. vhdl

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  2. 实现60进制计数 二十字街啊?我靠还不够-Count 20 words of 60 binary implementation Street ah? I rely on is not enough
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:13312
    • 提供者:
  1. CNT4

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  2. 4进制加法计数器,实现简单的4进制计数功能, 有进位输出,清零复位的功能,简单易行.-4 binary counter addition, the 4 simple binary counting function, carry out, clear reset function, simple.
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:179200
    • 提供者:寒星
  1. counter24

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  2. 在数码管上实现24进制计数,当计数达到23时下一次再来脉冲,计数器归零,同时进位端置一-It is a counter base-24
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:3072
    • 提供者:杨洋
  1. counter

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  2. 使用verilog实现低位的十进制计数,高位的十六进制计数,带有Modelsim仿真测试文件-verilog Modelsim
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:2048
    • 提供者:杨毅
  1. miaobiao

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  2. 计数秒表,实现23进制计数清零,同时可以更改分频-Counting stopwatch, to achieve 23 decimal count is cleared and you can change the frequency
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:1404928
    • 提供者:陈学虎
  1. cnt24

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  2. 24进制计数器,实现了电子时钟小时位的24进制计数-24 hex counter
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:3072
    • 提供者:Tom
  1. sy1(1)

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  2. 每按一次按键,累计按键次数并通过LED显示出来,且采用16进制计数。-Each time you press the button, the cumulative number of keystrokes and through the LED display and hexadecimal count.
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2024-06-11
    • 文件大小:15360
    • 提供者:钟建新
  1. mnppqbs

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  2. 用8个LED发光管(红黄绿)的来回滚动显示来模拟打乒乓球时乒乓球在两边球台上的来回运动。比赛双方用按钮/开关(双方各用一个按钮/开关)来模拟发球与接球,即发球方按动其控制的按钮/开关,球从发球方一侧向另一方运动(LED发光管从发球方到对方逐个点亮,滚动显示),当球运动至接球方时,接球方立即按动其控制的按钮/开关,“击球”使球“弹回”发球方一侧,如此周而复始,直至在规定的击球时间内有一方未能完成击球动作,从而对方的一分,然后继续比赛。比赛
  3. 所属分类:汇编语言

    • 发布日期:2024-06-11
    • 文件大小:2048
    • 提供者:
  1. code

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  2. 通过对十字路*通灯控制系统的设计,掌握不同进制计数归零的描述方法以 及通过信号使进程进行相互通信的方法。-Through the intersection traffic light control system design, master describes different methods to zero and the decimal counting processes via signal to communica
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-11
    • 文件大小:1024
    • 提供者:张双图
  1. 设计60

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  2. 用74ls161实现60进制计数功能,异步清零法(74161 to achieve 60 hexadecimal)
  3. 所属分类:其他小程序

    • 发布日期:2024-06-11
    • 文件大小:106496
    • 提供者:fpgaaaaaaa
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