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[VHDL编程] The-key-control-divider
说明:这是一个利用VHDL代码编写通过按键控制的分频器,通过给按键s3、s2、s1、s0赋不同的值,可以使分频器输出不同频率,此代码原用于自制示波器的分频。-This is a use of the VHDL code written by key control divider divider output through to key s3, s2, s1, s0 endowed different values, different frequencies, this code is the o<yubaoming> 在 2025-07-08 上传 | 大小:6kb | 下载:0
[matlab例程] matlabzhuchengfen
说明:主成分分析的MATLAB源代码,功能有主成分分析、残差、巴特利特检验等-MATLAB source code of the principal component analysis, functional principal component analysis, residuals Bartlett test<杨晓冬> 在 2025-07-08 上传 | 大小:8kb | 下载:0
[android开发] AnimRoundProcessDialog
说明:定义loading效果,使用的是progressbar-Define the loading effect<李辉> 在 2025-07-08 上传 | 大小:70kb | 下载:0
[VHDL编程] scanled
说明:利用FPGA系统电路控制8个LED进行4种工作模式状态的循环显示,这四种工作模式状态是:(1)从左到右逐个点亮LED(2)从右到左逐个点亮LED(3)从两边到中间逐个显示LED(4)从中间到两边逐个显示LED.-The FPGA system circuit control 8 LED status of the four operating modes cycle through four operating modes state: (1) from left to right by-lit<yubaoming> 在 2025-07-08 上传 | 大小:569kb | 下载:0
[VHDL编程] 3-seconds-alarm
说明:这是一个使用vhdl语言编写的fpga程序,能够实现报警三秒钟的功能。-This is a use of language vhdl fpga program can realize alarm functionality of three seconds.<yubaoming> 在 2025-07-08 上传 | 大小:324kb | 下载:0
[其他小程序] crcGenerator
说明:crc校验产生器,输入信息位,输出加校验位的信息位-CRC checksum generator, the input information bits, the output of information bits plus parity bit<yupeng> 在 2025-07-08 上传 | 大小:1kb | 下载:0
[数学计算/工程计算] CRFPP-0.53
说明:基于CRF++-0.53的改良版,修正了模型输入时多行空行导致的线程错误,优化了多线程操作,除LBFGS无法优化外,其余迭代操作全部多线程化,66MB模型在16线程服务器上运行,内存占用5.35GB,CPU利用率一般100 ,只有运行LBFGS时为7 。仅支持64位Windows操作系统,使用VC2008编译,不支持32位操作系统或Linux(Windows线程模型)。-Optimized CRF++-0.53. Fixed multi-empty line input bug. Optimiz<吴岳> 在 2025-07-08 上传 | 大小:43kb | 下载:0