[Windows编程] FIRST1

说明：编写并调试一个模拟的进程调度程序，采用“最高优先数优先”调度算法对五个进程进行调度。 　　“最高优先数优先”调度算法的基本思想是把CPU分配给就绪队列中优先数最高的进程。静态优先数是在创建进程时确定的，并在整个进程运行期间不再改变。 　　动态优先数是指进程的优先数在创建进程时可以给定一个初始值，并且可以按一定原则修改优先数。例如：在进程获得一次CPU后就将其优先数减少1，或者，进程等待的时间超过某一时限时增加其优先数的值，等等。 -Write and debug a simulati
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[Windows编程] FIRST2

说明：编写并调试一个模拟的进程调度程序，采用“轮转法”调度算法对五个进程进行调度。 　　轮转法可以是简单轮转法、可变时间片轮转法，或多队列轮转法。 -Write and debug a simulation of the process scheduling program, a "Round-Robin" scheduling algorithm for scheduling the five process. Round-Robin Round-Robin method can be
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[Windows编程] 4

说明： 用邻接表表示图的拓扑排序算法-failed to translate
<hrx> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[Windows编程] 5

说明：本程序提供了用顺序表实现字典的情况下 的顺序检索算法-This procedure provides a realization of a dictionary with the order form under the order of retrieval algorithms
<hrx> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[Windows编程] 6

说明： 用邻接矩阵表示的图的Dijkstra算法的源程序-With the adjacency matrix of the graph Dijkstra algorithm source code
<hrx> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[Windows编程] 7

说明： 用循环单链表解决josephus问题的算法-Circular single linked list using an algorithm to solve the problem josephus
<hrx> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[C#编程] Hashlist

说明：哈希队列,解决哈希表不能按序号直接访问的问题-array list that contains all the keys as they are inserted, the index is associated with a key so when pulling out values by index
<阿滨> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[其他小程序] verilog_count4_led7s

说明：利用子模块四位计数器及七段数码显示译码器，设置成一个可以数码显示的四位计数器-The use of sub-module 4 seven-segment digital display counter and decoder can be set to a digital display of the four counters
<谌兵兵> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[其他小程序] FunCRC

说明：CRC的实现，可直接使用，方便的函数-implement CRC,used directely,it is a good fun.
<qiush> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[其他小程序] knapsack

说明：c语言实现的0-1背包问题，很简单，运行正常可靠，页面简洁。-c language implementation of the 0-1 knapsack problem, is very simple, operating normally reliable, simple page.
<风筝> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[其他小程序] New

说明：小试牛刀 一下，希望各位可以以此作为学习C语言的门路-little try
<张廷> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[其他小程序] serial_in

说明：verilog 串并转换程序 状态机 有4位前导码 共转换3位 可自己修改后转换更多的串行数据位-Verilog serial signal to parallel signal transfer
<will zhang> 在 2025-06-15 上传 | 大小：1kb | 下载：0