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  1. multi_clock_design_in_large_scale_FPGA

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  2. 用FPGA实现大型设计时，可能需要FPGA具有以多个时钟运行的多重数据通路，这种多时钟FPGA设计必须特别小心，需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟，以及如何进行布线

  3. 所属分类：软件工程

    • 发布日期：2008-10-13
    • 文件大小：102079

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