文件名称:xiaoxipro

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 609kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • joh****
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  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

某多功能世界电子时钟产品的verilog 源代码, 包含闰年等众多功能, 可以直接下载入fpga使用-A multi-function products in the world electronic clock verilog source code, including leap year and many other features, can be directly downloaded into the fpga to use
相关搜索: 电子时钟

(系统自动生成,下载前可以参看下载内容)

下载文件列表

au.v

clk1000hz.v

clock.v

day_c.v

month_c.v

rev_6

.....\alt_max2.vo

.....\clock.acf

.....\clock.edf

.....\clock.fit

.....\clock.fse

.....\clock.hex

.....\clock.hif

.....\clock.mmf

.....\clock.ndb

.....\clock.pin

.....\clock.plg

.....\clock.pof

.....\clock.rpt

.....\clock.sat

.....\clock.snf

.....\clock.sof

.....\clock.srd

.....\clock.srm

.....\clock.srr

.....\clock.srs

.....\clock.tcl

.....\clock.tlg

.....\clock.ttf

.....\clock.vm

.....\clock.vo

.....\clock_cons.tcl

.....\clock_rm.tcl

scan.v

seven_seg.v

three_eight.v

timer.v

up_count_10.v

up_count_1000.v

up_count_125.v

up_count_500.v

up_count_6.v

up_count_7.v

year_c.v

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