文件名称:sin

  • 所属分类:
  • 其它资源
  • 资源属性:
  • [ASM] [源码]
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  • 2008-10-13
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  • 2.41mb
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介绍说明--下载内容均来自于网络,请自行研究使用

正弦信号发生器程序,用VERILOG写出。
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : 45665992sin.rar 列表
正弦信号发生器\_ODELSIM\ROM.V
正弦信号发生器\_ODELSIM\SIN_TOP.MPF
正弦信号发生器\_ODELSIM\SIN_TOP.V
正弦信号发生器\_ODELSIM\VSIM.WLF
正弦信号发生器\_ODELSIM\sin_top.cr.mti
正弦信号发生器\_ODELSIM\sin_top_TB.v
正弦信号发生器\_ODELSIM\dataHEX\SDATA.ASM
正弦信号发生器\_ODELSIM\dataHEX\SDATA.BIN
正弦信号发生器\_ODELSIM\dataHEX\SDATA.HEX
正弦信号发生器\_ODELSIM\dataHEX\SDATA.LST
正弦信号发生器\_ODELSIM\WORK\_INFO
正弦信号发生器\_ODELSIM\WORK\stratixgx_dpa_lvds_rx\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratixgx_dpa_lvds_rx\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratixgx_dpa_lvds_rx\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_rublock\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_rublock\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_rublock\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_ram_register\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_ram_register\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_ram_register\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_ram_internal\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_ram_internal\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_ram_internal\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_ram_clear\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_ram_clear\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_ram_clear\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_ram_block\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_ram_block\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_ram_block\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_pll\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_pll\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_pll\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_mac_register\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_mac_register\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_mac_register\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_mac_out_internal\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_mac_out_internal\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_mac_out_internal\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_mac_out\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_mac_out\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_mac_out\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_mac_mult_internal\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_mac_mult_internal\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_mac_mult_internal\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_mac_mult\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_mac_mult\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_mac_mult\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_tx_parallel_register\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_tx_parallel_register\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_tx_parallel_register\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_tx_out_block\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_tx_out_block\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_tx_out_block\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_transmitter\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_transmitter\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_transmitter\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_rx_parallel_register\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_rx_parallel_register\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_rx_parallel_register\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_rx\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_rx\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_rx\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_receiver\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_receiver\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_receiver\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_lcell_register\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_lcell_register\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_lcell_register\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_lcell\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_lcell\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_lcell\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_jtag\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_jtag\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_jtag\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_io_register\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_io_register\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_io_register\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_io\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_io\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_io\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_dll\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_dll\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_dll\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_crcblock\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_crcblock\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_crcblock\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_asynch_lcell\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_asynch_lcell\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_asynch_lcell\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\stratix_asynch_io\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\stratix_asynch_io\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\stratix_asynch_io\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\sin_top_tb\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\sin_top_tb\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\sin_top_tb\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\scale_cntr\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\scale_cntr\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\scale_cntr\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\parallel_add\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\parallel_add\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\parallel_add\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_shiftreg\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_shiftreg\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_shiftreg\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_ram_io\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_ram_io\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_ram_io\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_ram_dq\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_ram_dq\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_ram_dq\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_ram_dp\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_ram_dp\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_ram_dp\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_outpad\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_outpad\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_outpad\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_latch\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_latch\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_latch\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_inpad\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_inpad\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_inpad\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_fefifo\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_fefifo\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_fefifo\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_dffpipe\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_dffpipe\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_dffpipe\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_async\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_async\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_async\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_divide\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_divide\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_divide\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_decode\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_decode\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_decode\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_counter\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_counter\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_counter\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_constant\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_constant\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_constant\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_compare\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_compare\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_compare\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_clshift\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_clshift\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_clshift\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_bustri\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_bustri\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_bustri\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_bipad\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_bipad\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_bipad\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\lpm_add_sub\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\lpm_add_sub\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\lpm_add_sub\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\hssi_fifo\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\hssi_fifo\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\hssi_fifo\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\dcfifo_sync\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\dcfifo_sync\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\dcfifo_sync\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\dcfifo_fefifo\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\dcfifo_fefifo\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\dcfifo_fefifo\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\dcfifo_dffpipe\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\dcfifo_dffpipe\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\dcfifo_dffpipe\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\dcfifo_async\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\dcfifo_async\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\dcfifo_async\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\carry_sum\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\carry_sum\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\carry_sum\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\arm_scale_cntr\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\arm_scale_cntr\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\arm_scale_cntr\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\arm_n_cntr\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\arm_n_cntr\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\arm_n_cntr\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\arm_m_cntr\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\arm_m_cntr\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\arm_m_cntr\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altsyncram\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altsyncram\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altsyncram\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altshift_taps\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altshift_taps\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altshift_taps\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altmult_add\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altmult_add\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altmult_add\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altmult_accum\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altmult_accum\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altmult_accum\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altlvds_tx\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altlvds_tx\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altlvds_tx\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altlvds_rx\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altlvds_rx\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altlvds_rx\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altfp_mult\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altfp_mult\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altfp_mult\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altddio_out\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altddio_out\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altddio_out\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altddio_in\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altddio_in\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altddio_in\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altddio_bidir\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altddio_bidir\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altddio_bidir\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altclklock\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altclklock\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altclklock\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altcdr_tx\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altcdr_tx\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altcdr_tx\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altcdr_rx\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altcdr_rx\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altcdr_rx\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\altaccumulate\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\altaccumulate\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\altaccumulate\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\alt_exc_upcore\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\alt_exc_upcore\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\alt_exc_upcore\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\alt_exc_dpram\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\alt_exc_dpram\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\alt_exc_dpram\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\a_graycounter\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\a_graycounter\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\a_graycounter\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\SIN_TOP\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\SIN_TOP\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\SIN_TOP\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\SCFIFO\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\SCFIFO\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\SCFIFO\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\ROM\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\ROM\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\ROM\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\PLL_REG\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\PLL_REG\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\PLL_REG\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\N_CNTR\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\N_CNTR\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\N_CNTR\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\NMUX21\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\NMUX21\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\NMUX21\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\M_CNTR\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\M_CNTR\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\M_CNTR\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\MUX41\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\MUX41\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\MUX41\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\MUX21\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\MUX21\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\MUX21\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_XOR\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_XOR\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_XOR\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_ROM\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_ROM\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_ROM\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_OR\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_OR\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_OR\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_MUX\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_MUX\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_MUX\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_MULT\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_MULT\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_MULT\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_INV\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_INV\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_INV\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_FIFO\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_FIFO\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_FIFO\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_FF\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_FF\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_FF\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_AND\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_AND\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_AND\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LPM_ABS\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LPM_ABS\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LPM_ABS\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LCELL\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LCELL\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LCELL\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\LATCH\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\LATCH\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\LATCH\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\HSSI_TX\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\HSSI_TX\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\HSSI_TX\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\HSSI_RX\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\HSSI_RX\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\HSSI_RX\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\HSSI_PLL\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\HSSI_PLL\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\HSSI_PLL\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\GLOBAL\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\GLOBAL\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\GLOBAL\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\EXP\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\EXP\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\EXP\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\DFFP\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\DFFP\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\DFFP\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\DFFE\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\DFFE\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\DFFE\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\DCFIFO\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\DCFIFO\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\DCFIFO\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\CASCADE\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\CASCADE\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\CASCADE\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\CARRY\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\CARRY\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\CARRY\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\BMUX21\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\BMUX21\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\BMUX21\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\B5MUX21\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\B5MUX21\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\B5MUX21\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\B17MUX21\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\B17MUX21\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\B17MUX21\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\AND16\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\AND16\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\AND16\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\AND1\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\AND1\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\AND1\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\ALTSQRT\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\ALTSQRT\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\ALTSQRT\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\ALTQPRAM\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\ALTQPRAM\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\ALTQPRAM\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\ALTPLL\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\ALTPLL\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\ALTPLL\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\ALTDPRAM\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\ALTDPRAM\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\ALTDPRAM\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\ALTCAM\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\ALTCAM\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\ALTCAM\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\ALT3PRAM\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\ALT3PRAM\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\ALT3PRAM\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\@p@r@i@m_@d@f@f@e\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\@p@r@i@m_@d@f@f@e\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\@p@r@i@m_@d@f@f@e\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\@m@f_stratixii_pll\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\@m@f_stratixii_pll\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\@m@f_stratixii_pll\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\@m@f_stratix_pll\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\@m@f_stratix_pll\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\@m@f_stratix_pll\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\@m@f_ram7x20_syn\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\@m@f_ram7x20_syn\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\@m@f_ram7x20_syn\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\@m@f_pll_reg\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\@m@f_pll_reg\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\@m@f_pll_reg\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\@l@p@m_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\@l@p@m_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\@l@p@m_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\@l@p@m_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\@l@p@m_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\@l@p@m_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\_PRIMARY.VHD
正弦信号发生器\_ODELSIM\WORK\@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\VERILOG.ASM
正弦信号发生器\_ODELSIM\WORK\@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\_PRIMARY.DAT
正弦信号发生器\_ODELSIM\WORK\@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\_PRIMARY.VHD
正弦信号发生器\Verilog\DAC0832.QPF
正弦信号发生器\Verilog\DAC0832.QWS
正弦信号发生器\Verilog\ROM.V
正弦信号发生器\Verilog\SIN_TOP.CDF
正弦信号发生器\Verilog\SIN_TOP.PIN
正弦信号发生器\Verilog\SIN_TOP.POF
正弦信号发生器\Verilog\SIN_TOP.QSF
正弦信号发生器\Verilog\SIN_TOP.SOF
正弦信号发生器\Verilog\SIN_TOP.V
正弦信号发生器\Verilog\STP1.STP
正弦信号发生器\Verilog\cmp_state.ini
正弦信号发生器\Verilog\sin_top.asm.rpt
正弦信号发生器\Verilog\sin_top.done
正弦信号发生器\Verilog\sin_top.fit.eqn
正弦信号发生器\Verilog\sin_top.fit.rpt
正弦信号发生器\Verilog\sin_top.fit.summary
正弦信号发生器\Verilog\sin_top.flow.rpt
正弦信号发生器\Verilog\sin_top.map.eqn
正弦信号发生器\Verilog\sin_top.map.rpt
正弦信号发生器\Verilog\sin_top.map.summary
正弦信号发生器\Verilog\sin_top.tan.rpt
正弦信号发生器\Verilog\sin_top.tan.summary
正弦信号发生器\Verilog\sin_top_description.txt
正弦信号发生器\Verilog\dataHEX\SDATA.ASM
正弦信号发生器\Verilog\dataHEX\SDATA.BIN
正弦信号发生器\Verilog\dataHEX\SDATA.HEX
正弦信号发生器\Verilog\dataHEX\SDATA.LST
正弦信号发生器\Verilog\DB\CNTR_1A9.TDF
正弦信号发生器\Verilog\DB\CNTR_3A9.TDF
正弦信号发生器\Verilog\DB\CNTR_7V7.TDF
正弦信号发生器\Verilog\DB\CNTR_909.TDF
正弦信号发生器\Verilog\DB\CNTR_B09.TDF
正弦信号发生器\Verilog\DB\CNTR_FV7.TDF
正弦信号发生器\Verilog\DB\CNTR_H5A.TDF
正弦信号发生器\Verilog\DB\CNTR_P5A.TDF
正弦信号发生器\Verilog\DB\CNTR_U68.TDF
正弦信号发生器\Verilog\DB\CNTR_V68.TDF
正弦信号发生器\Verilog\DB\MUX_VJB.TDF
正弦信号发生器\Verilog\DB\altsyncram_5sq.tdf
正弦信号发生器\Verilog\DB\altsyncram_jp92.tdf
正弦信号发生器\Verilog\DB\altsyncram_lp92.tdf
正弦信号发生器\Verilog\DB\altsyncram_np92.tdf
正弦信号发生器\Verilog\DB\altsyncram_pg91.tdf
正弦信号发生器\Verilog\DB\altsyncram_rg91.tdf
正弦信号发生器\Verilog\DB\altsyncram_tg91.tdf
正弦信号发生器\Verilog\DB\decode_1oa.tdf
正弦信号发生器\Verilog\DB\decode_rpe.tdf
正弦信号发生器\Verilog\DB\sin_top.(0).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(0).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(1).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(1).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(10).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(10).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(11).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(11).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(12).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(12).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(13).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(13).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(14).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(14).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(15).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(15).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(16).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(16).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(17).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(17).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(18).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(18).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(19).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(19).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(2).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(2).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(20).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(20).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(21).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(21).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(22).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(22).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(23).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(23).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(24).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(24).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(25).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(25).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(26).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(26).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(27).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(27).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(28).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(28).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(29).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(29).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(3).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(3).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(30).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(30).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(31).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(31).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(32).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(32).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(33).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(33).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(34).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(34).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(35).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(35).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(36).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(36).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(37).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(37).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(38).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(38).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(39).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(39).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(4).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(4).cnf.hdb
正弦信号发生器\Verilog\DB\sin_top.(40).cnf.cdb
正弦信号发生器\Verilog\DB\sin_top.(40).cnf.hdb
正弦信号发生器\Source\ROM.V
正弦信号发生器\Source\SIN_TOP.V
正弦信号发生器\Source\sin_top_TB.v
正弦信号发生器\Source\dataHEX\SDATA.ASM
正弦信号发生器\Source\dataHEX\SDATA.BIN
正弦信号发生器\Source\dataHEX\SDATA.HEX
正弦信号发生器\Source\dataHEX\SDATA.LST
正弦信号发生器\_ODELSIM\WORK\stratixgx_dpa_lvds_rx
正弦信号发生器\_ODELSIM\WORK\stratix_rublock
正弦信号发生器\_ODELSIM\WORK\stratix_ram_register
正弦信号发生器\_ODELSIM\WORK\stratix_ram_internal
正弦信号发生器\_ODELSIM\WORK\stratix_ram_clear
正弦信号发生器\_ODELSIM\WORK\stratix_ram_block
正弦信号发生器\_ODELSIM\WORK\stratix_pll
正弦信号发生器\_ODELSIM\WORK\stratix_mac_register
正弦信号发生器\_ODELSIM\WORK\stratix_mac_out_internal
正弦信号发生器\_ODELSIM\WORK\stratix_mac_out
正弦信号发生器\_ODELSIM\WORK\stratix_mac_mult_internal
正弦信号发生器\_ODELSIM\WORK\stratix_mac_mult
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_tx_parallel_register
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_tx_out_block
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_transmitter
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_rx_parallel_register
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_rx
正弦信号发生器\_ODELSIM\WORK\stratix_lvds_receiver
正弦信号发生器\_ODELSIM\WORK\stratix_lcell_register
正弦信号发生器\_ODELSIM\WORK\stratix_lcell
正弦信号发生器\_ODELSIM\WORK\stratix_jtag
正弦信号发生器\_ODELSIM\WORK\stratix_io_register
正弦信号发生器\_ODELSIM\WORK\stratix_io
正弦信号发生器\_ODELSIM\WORK\stratix_dll
正弦信号发生器\_ODELSIM\WORK\stratix_crcblock
正弦信号发生器\_ODELSIM\WORK\stratix_asynch_lcell
正弦信号发生器\_ODELSIM\WORK\stratix_asynch_io
正弦信号发生器\_ODELSIM\WORK\sin_top_tb
正弦信号发生器\_ODELSIM\WORK\scale_cntr
正弦信号发生器\_ODELSIM\WORK\parallel_add
正弦信号发生器\_ODELSIM\WORK\lpm_shiftreg
正弦信号发生器\_ODELSIM\WORK\lpm_ram_io
正弦信号发生器\_ODELSIM\WORK\lpm_ram_dq
正弦信号发生器\_ODELSIM\WORK\lpm_ram_dp
正弦信号发生器\_ODELSIM\WORK\lpm_outpad
正弦信号发生器\_ODELSIM\WORK\lpm_latch
正弦信号发生器\_ODELSIM\WORK\lpm_inpad
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_fefifo
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_dffpipe
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc_async
正弦信号发生器\_ODELSIM\WORK\lpm_fifo_dc
正弦信号发生器\_ODELSIM\WORK\lpm_divide
正弦信号发生器\_ODELSIM\WORK\lpm_decode
正弦信号发生器\_ODELSIM\WORK\lpm_counter
正弦信号发生器\_ODELSIM\WORK\lpm_constant
正弦信号发生器\_ODELSIM\WORK\lpm_compare
正弦信号发生器\_ODELSIM\WORK\lpm_clshift
正弦信号发生器\_ODELSIM\WORK\lpm_bustri
正弦信号发生器\_ODELSIM\WORK\lpm_bipad
正弦信号发生器\_ODELSIM\WORK\lpm_add_sub
正弦信号发生器\_ODELSIM\WORK\hssi_fifo
正弦信号发生器\_ODELSIM\WORK\dcfifo_sync
正弦信号发生器\_ODELSIM\WORK\dcfifo_fefifo
正弦信号发生器\_ODELSIM\WORK\dcfifo_dffpipe
正弦信号发生器\_ODELSIM\WORK\dcfifo_async
正弦信号发生器\_ODELSIM\WORK\carry_sum
正弦信号发生器\_ODELSIM\WORK\arm_scale_cntr
正弦信号发生器\_ODELSIM\WORK\arm_n_cntr
正弦信号发生器\_ODELSIM\WORK\arm_m_cntr
正弦信号发生器\_ODELSIM\WORK\altsyncram
正弦信号发生器\_ODELSIM\WORK\altshift_taps
正弦信号发生器\_ODELSIM\WORK\altmult_add
正弦信号发生器\_ODELSIM\WORK\altmult_accum
正弦信号发生器\_ODELSIM\WORK\altlvds_tx
正弦信号发生器\_ODELSIM\WORK\altlvds_rx
正弦信号发生器\_ODELSIM\WORK\altfp_mult
正弦信号发生器\_ODELSIM\WORK\altddio_out
正弦信号发生器\_ODELSIM\WORK\altddio_in
正弦信号发生器\_ODELSIM\WORK\altddio_bidir
正弦信号发生器\_ODELSIM\WORK\altclklock
正弦信号发生器\_ODELSIM\WORK\altcdr_tx
正弦信号发生器\_ODELSIM\WORK\altcdr_rx
正弦信号发生器\_ODELSIM\WORK\altaccumulate
正弦信号发生器\_ODELSIM\WORK\alt_exc_upcore
正弦信号发生器\_ODELSIM\WORK\alt_exc_dpram
正弦信号发生器\_ODELSIM\WORK\a_graycounter
正弦信号发生器\_ODELSIM\WORK\SIN_TOP
正弦信号发生器\_ODELSIM\WORK\SCFIFO
正弦信号发生器\_ODELSIM\WORK\ROM
正弦信号发生器\_ODELSIM\WORK\PLL_REG
正弦信号发生器\_ODELSIM\WORK\N_CNTR
正弦信号发生器\_ODELSIM\WORK\NMUX21
正弦信号发生器\_ODELSIM\WORK\M_CNTR
正弦信号发生器\_ODELSIM\WORK\MUX41
正弦信号发生器\_ODELSIM\WORK\MUX21
正弦信号发生器\_ODELSIM\WORK\LPM_XOR
正弦信号发生器\_ODELSIM\WORK\LPM_ROM
正弦信号发生器\_ODELSIM\WORK\LPM_OR
正弦信号发生器\_ODELSIM\WORK\LPM_MUX
正弦信号发生器\_ODELSIM\WORK\LPM_MULT
正弦信号发生器\_ODELSIM\WORK\LPM_INV
正弦信号发生器\_ODELSIM\WORK\LPM_FIFO
正弦信号发生器\_ODELSIM\WORK\LPM_FF
正弦信号发生器\_ODELSIM\WORK\LPM_AND
正弦信号发生器\_ODELSIM\WORK\LPM_ABS
正弦信号发生器\_ODELSIM\WORK\LCELL
正弦信号发生器\_ODELSIM\WORK\LATCH
正弦信号发生器\_ODELSIM\WORK\HSSI_TX
正弦信号发生器\_ODELSIM\WORK\HSSI_RX
正弦信号发生器\_ODELSIM\WORK\HSSI_PLL
正弦信号发生器\_ODELSIM\WORK\GLOBAL
正弦信号发生器\_ODELSIM\WORK\EXP
正弦信号发生器\_ODELSIM\WORK\DFFP
正弦信号发生器\_ODELSIM\WORK\DFFE
正弦信号发生器\_ODELSIM\WORK\DCFIFO
正弦信号发生器\_ODELSIM\WORK\CASCADE
正弦信号发生器\_ODELSIM\WORK\CARRY
正弦信号发生器\_ODELSIM\WORK\BMUX21
正弦信号发生器\_ODELSIM\WORK\B5MUX21
正弦信号发生器\_ODELSIM\WORK\B17MUX21
正弦信号发生器\_ODELSIM\WORK\AND16
正弦信号发生器\_ODELSIM\WORK\AND1
正弦信号发生器\_ODELSIM\WORK\ALTSQRT
正弦信号发生器\_ODELSIM\WORK\ALTQPRAM
正弦信号发生器\_ODELSIM\WORK\ALTPLL
正弦信号发生器\_ODELSIM\WORK\ALTDPRAM
正弦信号发生器\_ODELSIM\WORK\ALTCAM
正弦信号发生器\_ODELSIM\WORK\ALT3PRAM
正弦信号发生器\_ODELSIM\WORK\@p@r@i@m_@d@f@f@e
正弦信号发生器\_ODELSIM\WORK\@m@f_stratixii_pll
正弦信号发生器\_ODELSIM\WORK\@m@f_stratix_pll
正弦信号发生器\_ODELSIM\WORK\@m@f_ram7x20_syn
正弦信号发生器\_ODELSIM\WORK\@m@f_pll_reg
正弦信号发生器\_ODELSIM\WORK\@l@p@m_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n
正弦信号发生器\_ODELSIM\WORK\@l@p@m_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s
正弦信号发生器\_ODELSIM\WORK\@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s
正弦信号发生器\_ODELSIM\dataHEX
正弦信号发生器\_ODELSIM\WORK
正弦信号发生器\Verilog\dataHEX
正弦信号发生器\Verilog\DB
正弦信号发生器\Source\dataHEX
正弦信号发生器\_ODELSIM
正弦信号发生器\Verilog
正弦信号发生器\Source
正弦信号发生器

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