文件名称:TX

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 101kb
  • 下载次数:
  • 0次
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1路视频光端机的发射端,VHDL源码,使用全FPGA芯片的硬件,内建成帧、时钟、SERDES-The launch of a video PDH client, VHDL source code, use the whole FPGA chip hardware, built-in framing, clock, SERDES
(系统自动生成,下载前可以参看下载内容)

下载文件列表

TX

..\db

..\..\TX.asm.qmsg

..\..\TX.cbx.xml

..\..\TX.cmp.rdb

..\..\TX.dbp

..\..\TX.db_info

..\..\TX.eco.cdb

..\..\TX.eds_overflow

..\..\TX.fit.qmsg

..\..\TX.hier_info

..\..\TX.hif

..\..\TX.map.cdb

..\..\TX.map.hdb

..\..\TX.map.logdb

..\..\TX.map.qmsg

..\..\TX.pre_map.cdb

..\..\TX.pre_map.hdb

..\..\TX.psp

..\..\TX.pss

..\..\TX.rpp.qmsg

..\..\TX.rtlv.hdb

..\..\TX.rtlv_sg.cdb

..\..\TX.rtlv_sg_swap.cdb

..\..\TX.sgate.rvd

..\..\TX.sgate_sm.rvd

..\..\TX.sgdiff.cdb

..\..\TX.sgdiff.hdb

..\..\TX.sim.hdb

..\..\TX.sim.qmsg

..\..\TX.sim.rdb

..\..\TX.sim_ori.vwf

..\..\TX.sld_design_entry.sci

..\..\TX.sld_design_entry_dsc.sci

..\..\TX.syn_hier_info

..\..\TX.tan.qmsg

..\..\wed.zsf

..\EN_8B10B.bsf

..\en_8b10b.vhd

..\OTHER.vhd

..\TX.asm.rpt

..\TX.bdf

..\TX.done

..\TX.dpf

..\TX.fit.rpt

..\TX.fit.summary

..\TX.flow.rpt

..\TX.map.rpt

..\TX.map.summary

..\TX.pin

..\TX.pof

..\TX.qpf

..\TX.qsf

..\TX.qws

..\TX.sim.rpt

..\TX.tan.rpt

..\TX.tan.summary

..\TX.vwf

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