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[VHDL编程] xilinx_ddr_verilog
说明：xilinx赛灵思的DDR控制器源码（包括仿真与说明文档），DDR为mt46v4m16。-Xilinx DDR controller source code (including simulation and documentation), DDR is mt46v4m16.<刘佳庆> 在 2025-09-25 上传 | 大小：128kb | 下载：0
[VHDL编程] altera_ddr_verilog
说明：altera的DDR控制器源码（包括仿真与说明文档），DDR为mt46v4m16，Verilog-The DDR controller source of altera (including simulation and documentation), DDR is mt46v4m16, Verilog<刘佳庆> 在 2025-09-25 上传 | 大小：736kb | 下载：0
[中间件编程] jpcap.dll-Pjpcap.jar
说明：Jpcap是一个能够捕获、发送网络数据包的ava 类库包 -Jpcap is a capture, transmission of network data package Java library package<会员> 在 2025-09-25 上传 | 大小：528kb | 下载：0
[LabView] labview-communication-with-RS485
说明：串口通讯,用RS485，连接电脑和下位机即可通讯-This will tell you how to use labview to communicate with RS485<melody> 在 2025-09-25 上传 | 大小：17kb | 下载：0
[VHDL编程] traffic-light
说明：该交通信号灯控制器用于控制一条主干道与一条乡村公路的交叉口的交通(如图8-1所示)，它必须具有下面的功能；由于主干道上来往的车辆较多，因此控制主干道的交通信号灯具有最高优先级，在默认情况下，主干道的绿灯点亮；乡村公路间断性地有车经过，有车来时乡村公路的交通灯必须变为绿灯，只需维持一段足够的时间，以便让车通过。只要乡村公路上不再有车辆，那么乡村公路上的绿灯马上变为黄灯，然后变为红灯；同时，主干道上的绿灯重新点亮；一传感器用于监视乡村公路上是否有车等待，它向控制器输入信号X；如果X=1，则表示有车等<杜松> 在 2025-09-25 上传 | 大小：1kb | 下载：0