[VHDL编程] mux4x1

说明：mux 4x1 with 2 control inputs, written in VHDL using 3 mathods: Logic gates, if, case. the fastest model is the one implemented with the case code.
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[加密解密] hundunjiami

说明：混沌加密应用于实际电路的VHDL语言编写的电路选通程序。-Chaotic encryption used in the actual circuit of the circuit VHDL language gating process.
<wangjianan> 在 2025-05-30 上传 | 大小：1kb | 下载：0

[VHDL编程] 4bitMultiplier

说明：4 bit multiplier implemented with behavioral VHDL code. in addition a visio shceme is attached along with a jpg copy for thoese fho dont have visio.
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[VHDL编程] Ripple_Counter

说明：Ripple carry counter with 4 bit resolution implemented in behavioral VHDL. attaches as well is a jpg with the logic gates bock diagram. this is an asinchronous design.
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[VHDL编程] Ripple_Carry_counter

说明：Ripple Carry Counter. the synchronous version of Ripple Counter. a bit less fasr version the ripple counter but a synchronmous one that will work well on FPGA. wrriten in behavioral VHDL.
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[文件格式] jc2348635

说明：很好很强大 是软件工程师妹妹一球的 的源代码 我贡献出来 艾 是做了一番思想斗争的-very good
<xiaokun> 在 2025-05-30 上传 | 大小：218kb | 下载：0

[JSP源码/Java] java_vrml_programing

说明：这是一本关于Java与vrml深入编程的书籍，内容非常好。-It s about java and vrml programing,a very good indeed book.
<肖生富> 在 2025-05-30 上传 | 大小：22.76mb | 下载：0

[嵌入式/单片机编程] shuzitongxinxitongjianmo01

说明：基于CPLD_FPGA的数字通信系统建模与设计，本学习资料共分为4个部分，此为第一部分，供对数字通信系统建模和设计有兴趣的朋友学习参考。-CPLD_FPGA based on the digital communication system modeling and design, the learning materials is divided into four parts, this is the first part of t
<wangjianan> 在 2025-05-30 上传 | 大小：1.05mb | 下载：0

[VHDL编程] shuzitongxinxitongjianmo02

说明：基于CPLD_FPGA的数字通信系统建模与设计，本学习资料共分为4个部分，此为第一部分，供对数字通信系统建模和设计有兴趣的朋友学习参考。-CPLD_FPGA based on the digital communication system modeling and design, the learning materials is divided into four parts, this is the first part of t
<wangjianan> 在 2025-05-30 上传 | 大小：929kb | 下载：0

[游戏] 3dgame

说明：用VC++编写的几款简单的3d游戏源代码! OpenGl 设计游戏 3D模型 动画模型 碰撞检测 场景编辑 -Using VC++, prepared by several simple games 3d source code! OpenGl game 3D model of the design model collision detection animation scene editor
<sss> 在 2025-05-30 上传 | 大小：7.86mb | 下载：0

[VHDL编程] telephone

说明：实现长途电话，市话的计时，还有免费电话 在verilog中用状态机实现-The achievement of long-distance calls, the city of the time, then, there are toll-free number in verilog state machine used to achieve
<邱波> 在 2025-05-30 上传 | 大小：1kb | 下载：0

[VHDL编程] shuzitongxinxitongjianmo04

说明：基于CPLD_FPGA的数字通信系统建模与设计，本学习资料共分为4个部分，此为第四部分，供对数字通信系统建模和设计有兴趣的朋友学习参考。-CPLD_FPGA based on the digital communication system modeling and design, the learning materials is divided into four parts, this is the fourth part of
<wangjianan> 在 2025-05-30 上传 | 大小：1.58mb | 下载：0