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[单片机(51,AVR,MSP430等)04---STM32_Timer

说明:stm32代码第四个 04 - STM32_Timer定时中断实验-stm32 code is the fourth 04- STM32_Timer timer interrupt test
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[单片机(51,AVR,MSP430等)05---RTC

说明:stm32代码第5个05 - RTC (实时时钟实验)-stm32 Code Section 5 05- RTC (real-time clock test)
<> 在 2025-12-25 上传 | 大小:319kb | 下载:0

[单片机(51,AVR,MSP430等)06---STM32_USBMem

说明:stm32试验第6个06 - STM32_USBMem 实验(接上USB成为电脑的U盘)-stm32 testing 6 06- STM32_USBMem experiment (connected to a computer' s USB U Disk)
<张亮> 在 2025-12-25 上传 | 大小:663kb | 下载:0

[嵌入式/单片机编程SSDClock

说明:Verilog code, counts (time base 60) used on fpga
<jo3mv> 在 2025-12-25 上传 | 大小:756kb | 下载:0

[单片机(51,AVR,MSP430等)ServoController

说明:Servo Motor Controller
<khairymassar> 在 2025-12-25 上传 | 大小:2.4mb | 下载:0

[VHDL编程code

说明:波特仪设计与实现,源代码,用单片机 FPGA实现 适合做类似项目的哥们下载!-Porter Instrument design and implementation, source code, suitable for single chip FPGA realization of similar projects with a buddy to download!
<阿力> 在 2025-12-25 上传 | 大小:2.11mb | 下载:0

[单片机(51,AVR,MSP430等)zigbee-demo

说明:无线测温演示程序 zigbee演示程序 -Zigbee wireless temperature demo demo
<阿力> 在 2025-12-25 上传 | 大小:6.06mb | 下载:0

[单片机(51,AVR,MSP430等)program-code

说明:用单片机开发的频率计 用汇编编写 用单片机开发的频率计 -Frequency Meter with Single Chip Microcontroller with the compilation of the preparation of development with a frequency counter
<阿力> 在 2025-12-25 上传 | 大小:7kb | 下载:0

[VHDL编程UART

说明:This vhdl code has a simple implementation of an UART receiver. This code was generated march 2011 as a universuty project
<plcpe> 在 2025-12-25 上传 | 大小:1kb | 下载:0

[嵌入式/单片机编程wangnianli

说明:万年历,显示时间,日期,还包括温度。由AT89C51+DS18B20+LED=组成。还包含了PROTEUS仿真-Calendar, display time, date, including temperature. The AT89C51+ DS18B20+ LED = composition. PROTEUS simulation also includes
<琴和 > 在 2025-12-25 上传 | 大小:95kb | 下载:0

[单片机(51,AVR,MSP430等)8-LED

说明:基于PIC16F877单片机的数码管显示程序-PIC16F877 microcontroller-based digital display program
<安妮> 在 2025-12-25 上传 | 大小:1kb | 下载:0

[VHDL编程Verilog-to-VHDL-translator

说明:描述了一个Verilog到VHDL翻译器的设计与实现。首先将Verilog模块转换为中间格式,然后按照预定义的翻译规则,生成功能等价的VHDL设计实体。该翻译器目前只支持Verilog的一个子集。通过Verilog-to-VHDL, 使得在Verilog.VHDL混合设计环境中重用Verilog设计成为可能。-Describes a Verilog to VHDL translator design and implementation. Verilog module into first
<liuyi> 在 2025-12-25 上传 | 大小:190kb | 下载:0
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