[单片机(51,AVR,MSP430等)] ucos-ii在C8051F020上的移植

说明：ucos-ii在C8051F020上的移植-ucos-ii on C8051F020 transplant
<周小强> 在 2025-09-28 上传 | 大小：148kb | 下载：0

[单片机(51,AVR,MSP430等)] DK3400_3420 USB R_W source code - Keil

说明：DK3400_3420 USB R_W source code - Keil-DK3400_3420 USB R_W source code- Keil
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[单片机(51,AVR,MSP430等)] MRFIC读写器-51汇编源程序及C51源程序

说明：MRFIC读写器-51汇编源程序及C51源程序.zip-MRFIC read-write-51 assembly source program and C51 source program zip
<刘超> 在 2025-09-28 上传 | 大小：63kb | 下载：0

[单片机(51,AVR,MSP430等)] KeilC51－pckey

说明：用Keil C51 编写的单片机使用PC键盘程序代码- Compilation monolithic integrated circuit uses the PC keyboard procedure code with Keil the C51
<刘超> 在 2025-09-28 上传 | 大小：8kb | 下载：0

[单片机(51,AVR,MSP430等)] IC卡读写器程序（ASM）及其测试程序（PC端）

说明：IC卡读写器程序（ASM）及其测试程序（PC端）.zip-IC card read-write procedure (ASM) and its test order (PC end) zip
<刘超> 在 2025-09-28 上传 | 大小：700kb | 下载：0

[单片机(51,AVR,MSP430等)] 《Franklin C-51程序设计》

说明：《Franklin C-51程序设计》经典入门- "Franklin C-51 Programming" the classics cross the threshold
<刘超> 在 2025-09-28 上传 | 大小：53kb | 下载：0

[单片机(51,AVR,MSP430等)] 3线双向零等待IO通讯机制

说明：3线双向零等待IO通讯机制 单片机通讯源代码带说明-3 bidirectional zero waited for the IO communication machine-made monolithic integrated circuit communication source code belt explained
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[单片机(51,AVR,MSP430等)] 单片机C语言音乐程序的制作方法

说明：单片机C语言音乐程序的源程序（KeilC代码）- Monolithic integrated circuit C language music procedure source program (KeilC code)
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[微处理器(ARM/PowerPC等)] ucosII_arm_source

说明：UCOS－II ARM代码（4510B）-UCOS- II ARM code (4510B)
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[VHDL编程] ClkScan

说明：此设计采用Verilog HDL硬件语言设计,在掌宇开发板上实现. 将整个电路分为两个子模块，一个提供同步信号（H_SYNC和V_SYNC）及像素位置信息；另一个接收像素位置信息，并输出颜色信号。这样便于进行图形修改，同时也容易实现- This design uses Verilog the HDL hardware language design, realizes on the palm space development board Divides into two stature
<> 在 2025-09-28 上传 | 大小：896kb | 下载：0

[VHDL编程] qdq_new

说明：采用Verilog HDL设计,在掌宇智能开发板上得到实现 根据抢答器的原理，整个电路可划分为三部分：采样电路、门控电路和译码电路- Uses Verilog the HDL design, obtains the realization basis on the palm space intelligence development board to snatch the answering principle, the entire electric circuit may divi
<> 在 2025-09-28 上传 | 大小：64kb | 下载：0

[VHDL编程] second&clk

说明：开发系统上采用的时钟信号的频率是20MHz，可分别设计计数器对其计数，包括计秒、分、小时、日、周、月以及年等。在每一级上显示输出，这样就构成了一个电子日历和时钟的模型。为了可以随意调整计数值，还应包含设定计数初值的电路-Development system using the clock signal frequency is 20MHz, the design can be counter to its count, including seconds, minutes, hours, day
<> 在 2025-09-28 上传 | 大小：329kb | 下载：0