[单片机(51,AVR,MSP430等)] qiuchangjifen

说明： 该记分器可实现球场比赛双方积分指示，设计者完成记分器的硬件和软件设计。 任务及要求： 1、发光二极管点阵显示比分 2、1000米远程设置比分 设计内容： 1、分析设计要求，明确性能指标；查阅资料、设计方案分析对比。 2、论证并确定合理的总体设计方案，绘制总体结构框图，分析工作原理。 3、完成各单元具体电路的设计：单片机最小系统、A/D转换、显示等电路。包括元器件选择、工作原理分析。 4、写出
<庆庆> 在 2025-05-28 上传 | 大小：110kb | 下载：0

[VHDL编程] calendar

说明：一个简单的日历子系统，有闰月检查，非常简单-A simple calendar subsystem
<绿竹小子> 在 2025-05-28 上传 | 大小：1kb | 下载：0

[单片机(51,AVR,MSP430等)] smartmirror

说明：一个以AVR系列中ATMAG 16 为核心的多功能系统源程序-An AVR series ATMAG 16 multi-functional system as the core source code
<绿竹小子> 在 2025-05-28 上传 | 大小：4kb | 下载：0

[VHDL编程] SystemVerilogAssertion

说明：SystemVerilog Assertion的应用例子。例子均在Synopsys VCS环境下编译通过。-The uploaded files are examples of Systemverilog Assertions. All of the codes are compiled successfully in Synopsys VCS environment.
<ls> 在 2025-05-28 上传 | 大小：5kb | 下载：0

[单片机(51,AVR,MSP430等)] dapjshiyan

说明：以51单片机为核心的数字电子钟系统源程序，用C语言编写-51 microcontroller as the core of digital electronic clock system source code, using C language
<绿竹小子> 在 2025-05-28 上传 | 大小：2kb | 下载：0

[VHDL编程] snake

说明：在数码管上跑的贪吃蛇Verilog 程序-In the digital Verilog programs run on Snake
<绿竹小子> 在 2025-05-28 上传 | 大小：1kb | 下载：0

[DSP编程] CE128_ECAN_FIFO_061008

说明：MicroChip dsPIC33FJ64Gp706 C30 compiler ECAN Sample
<dyi> 在 2025-05-28 上传 | 大小：51kb | 下载：0

[VHDL编程] sm

说明：This example shows how a Sm component is directly coded in VHDL as concurrent statements. The multiplexor is coded as a single "when" statement. "Sm" is mnemonic for subtractor-multiplexor.
<Gopi> 在 2025-05-28 上传 | 大小：298kb | 下载：0

[VHDL编程] lab_instructions1

说明：The objective of the labs today is to give you a basic understanding of FPGA design and enough experience to begin your own FPGA design with the ISE 10.1 tools and the Xilinx Spartan-3A DSP 1800A Starter Kit.-The o
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[VHDL编程] lab_instructions2

说明：The objective of the labs today is to give you a basic understanding of FPGA design and enough experience to begin your own FPGA design with the ISE 10.1 tools and the Xilinx Spartan-3A DSP 1800A Starter Kit.-The o
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[VHDL编程] lab_instructions3

说明：The objective of the labs today is to give you a basic understanding of FPGA design and enough experience to begin your own FPGA design with the ISE 10.1 tools and the Xilinx Spartan-3A DSP 1800A Starter Kit.-The o
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[VHDL编程] Spartan-3ADSPs

说明：The objective of the labs today is to give you a basic understanding of FPGA design and enough experience to begin your own FPGA design with the ISE 10.1 tools and the Xilinx Spartan-3A DSP 1800A Starter Kit.-The o
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