[VHDL编程] cla16

说明：verilog code 16-bit carry look-ahead adder output [15:0] sum // 相加總和 output carryout // 進位 input [15:0] A_in // 輸入A input [15:0] B_in // 輸入B input carryin // 第一級進位 C0 -verilog code16-bit carry look-ahead adderoutput [15:0] sum// sum of
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[VHDL编程] array_multiplier

说明：verilog code array_multiplier output [7:0] product input [3:0] wire_x input [3:0] wire_y -verilog codearray_multiplieroutput [7:0] product input [3:0] wire_x input [3:0] wire_y
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[VHDL编程] SRT

说明：verilog code radix-2 SRT divider input [7:0]Dividend input [3:0]Divisor output [4:0]Quotient output [8:0]Remainder -verilog coderadix-2 SRT dividerinput [7:0] Dividend input [3:0] Divisor output [4:0] Quotient output [8:0] Remainde
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[单片机(51,AVR,MSP430等)] Text1

说明：基于51单片机系统的出租车计价器程序，实现在白天和晚上不同的计价，并且有里程数和堵车时间的计价-Based on 51 single-chip microcomputer system Taximeter procedures, to achieve in the daytime and at night different pricing, and mileage and time congestion pricing
<黄炜> 在 2025-11-03 上传 | 大小：2kb | 下载：0

[单片机(51,AVR,MSP430等)] at89c52_max7219_eclock

说明：基于at89c52单片机及max7219的电子时钟源程序-Based on AT89C52 Microcontroller and MAX7219 electronic clock source
<brave_gen> 在 2025-11-03 上传 | 大小：2kb | 下载：0

[单片机(51,AVR,MSP430等)] icl7135voltage_meter

说明：基于AT89C52及ICL7135的４位半数字电压表源代码-Based on AT89C52 and ICL7135 the four semi-digital voltage meter source code
<brave_gen> 在 2025-11-03 上传 | 大小：2kb | 下载：0

[嵌入式Linux] at91_nand

说明：at91开发板（ARM920T)NAND flash linux驱动程序-AT91 Development Board (ARM920T) NAND flash linux drivers
<brave_gen> 在 2025-11-03 上传 | 大小：2kb | 下载：0

[单片机(51,AVR,MSP430等)] ww

说明：ds18b20的温度显示程序，显示到数码管，并可以进行温度报警的上限设置-DS18B20 temperature display program, indicating that the digital tube, and can set the upper limit of temperature alarm
<wangluxin> 在 2025-11-03 上传 | 大小：2kb | 下载：0

[Windows CE] nand

说明：SMDK6400_WinCE_Nand 驅動源代碼-SMDK6400_WinCE_Nand driver source code
<xtrgm> 在 2025-11-03 上传 | 大小：2kb | 下载：0

[微处理器(ARM/PowerPC等)] S1D13700

说明：使用ATMEGA8515驅動320*240LCM完整程式碼-ATMEGA8515 drive to use 320* 240LCM integrity code
<洪小順> 在 2025-11-03 上传 | 大小：2kb | 下载：0

[单片机(51,AVR,MSP430等)] CAN

说明：一个测试过的非常好用的CAN 的多级通讯的实例-A test had been very useful multi-level communication CAN example
<he> 在 2025-11-03 上传 | 大小：2kb | 下载：0

[VHDL编程] VerilogDHL_clock

说明：新来匝道穿上别人写的基于vhd的数字时钟很好大家看看啊，很规范的哦。-New ramp to wear someone else wrote vhd on the digital clock very well take a look at the ah, oh, very norms.
<olive> 在 2025-11-03 上传 | 大小：2kb | 下载：0