[VxWorks] wait

说明：/* wait.h - wait facility library header */ /* * Copyright (c) 2003-2006 Wind River Systems, Inc. * * The right to copy, distribute or otherwise make use of this software * may be licensed only pursuant
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[VxWorks] snark

说明：/* $Header: /usr/cvsroot/target/h/wrn/wm/util/port/vxworks/snark.h,v 1.1.1.1 2001/11/05 17:47:17 tneale Exp $ */ /* * Copyright (C) 1999-2005 Wind River Systems, Inc. * All rights reserved. Provided under lice
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[VxWorks] dma

说明：/* dma.h - DMA (direct memory access) header */ /* Copyright 1984-1992 Wind River Systems, Inc. */ /* modification history -------------------- 01e,22sep92,rrr added support for c++ 01d,04jul92,jcf clea
<liaozhigao> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[VxWorks] ramDrv

说明：/* ramDrv.h - header file for ramDrv.c */ /* Copyright 1984-1992 Wind River Systems, Inc. */ /* modification history -------------------- 01f,22sep92,rrr added support for c++ 01e,18sep92,jcf added incl
<liaozhigao> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[单片机(51,AVR,MSP430等)] PIC18f4620

说明：PIC18f4620单片机，AD模块采集程序。-PIC18f4620 microcontroller the AD module acquisition program.
<张三丰> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[单片机(51,AVR,MSP430等)] I2C

说明：51单片机模拟I2C总线，单独测试小程序。-51 single-chip analog I2C bus, a separate test applet.
<娄城磊> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[单片机(51,AVR,MSP430等)] main

说明：用STC12C5A16S2实现超声波测距。-Ultrasonic Ranging STC12C5A16S2 achieve.
<娄城磊> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[单片机(51,AVR,MSP430等)] 163disk

说明：流水灯就是 八个闪光灯在一直循环的闪烁-Light water
<胡的> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[单片机(51,AVR,MSP430等)] 30-kinds--LED

说明：具有30种花样的流水灯汇编源程序，集多种类型样式流水灯，很漂亮！-30 pattern light water assembler source, set light water of a variety of type styles, very beautiful!
<SengChuary> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[VHDL编程] divider

说明：VERILOG编写的24位除法器代码核，是FPGA或者ASIC设计中的一核心计算模块。-VERILOG written 24 divider code nuclear FPGA or ASIC design in a core module.
<Solomon> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[其他嵌入式/单片机内容] duanxin

说明：单片机与GSM模块测试程序 单片机控制GSM模块向预设手机号码发送短信-Single-chip GSM module test procedures SCM control GSM module to send text messages to the default phone number
<安小徽> 在 2025-05-26 上传 | 大小：1kb | 下载：0

[VHDL编程] sqrt

说明：VERILOG描述的开平方模块核，开方运算是FPGA或ASIC设计中所需要的核心运算模块。-VERILOG descr iption of open square modules nuclear root operation is the core computing module FPGA or ASIC design.
<Solomon> 在 2025-05-26 上传 | 大小：1kb | 下载：0