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[VHDL编程] ASI_simulation
说明:异步串行接口ASI仿真设计,quartus modelsim 仿真参考设计,实现ASI传输,完成8b/10b转换,串并转换-Asynchronous Serial Interface ASI simulation design, quartus modelsim simulation reference design, implementation ASI transmission, complete 8b/10b conversion, serial-parallel conversion<wsc> 在 2025-06-24 上传 | 大小:591kb | 下载:0
[VHDL编程] filtra-lowpass
说明:this a lowpass filtre in VHDL code with a test_bench you will find some specifications of the FIR-this is a lowpass filtre in VHDL code with a test_bench you will find some specifications of the FIR<mortadha> 在 2025-06-24 上传 | 大小:5kb | 下载:0
[VHDL编程] CrossClockDomain
说明:跨时钟域设计不错的设计,进过modelsim仿真通过。-Cross-clock domain design is good design been to modelsim simulation through.<松鼠> 在 2025-06-24 上传 | 大小:1kb | 下载:0
[VHDL编程] sdr_ctrl_latest.tar
说明:SDRAM控制器设计源码,内含仿真代码,测试通过-SDRAM controller design source code, include simulation code, test by<松鼠> 在 2025-06-24 上传 | 大小:2.15mb | 下载:0