[VHDL编程] Alteradesigndocument

说明：本实验程序每个工程示例都包括了该工程的项目文件、源文件、报告文件和生成结果等文件，读者可以用Quartus II或相应的软件直接打开。设计源文件根据设计输入类型分为源代码或原理图等。-The experimental procedure for each project examples include the works of the project file, source documents, reports and other documents file and generate th
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[VHDL编程] Example-b3-1

说明：每个工程示例都包括了该工程的项目文件、源文件、报告文件和生成结果等文件，读者可以用Quartus II或相应的软件直接打开。设计源文件根据设计输入类型分为源代码或原理图等。-Each project examples include the project files of the project, source files, report files and generate the results files, the reader can use Quartus II or the sof
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[VHDL编程] Example-b8-1

说明：每个工程示例都包括了该工程的项目文件、源文件、报告文件和生成结果等文件，读者可以用Quartus II或相应的软件直接打开。设计源文件根据设计输入类型分为源代码或原理图等。-Each project examples include the project files of the project, source files, report files and generate the results files, the reader can use Quartus II or the sof
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[VHDL编程] Example-b8-2

说明：每个工程示例都包括了该工程的项目文件、源文件、报告文件和生成结果等文件，读者可以用Quartus II或相应的软件直接打开。设计源文件根据设计输入类型分为源代码或原理图等。-Each project examples include the project files of the project, source files, report files and generate the results files, the reader can use Quartus II or the sof
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[VHDL编程] Example-b8-3

说明：每个工程示例都包括了该工程的项目文件、源文件、报告文件和生成结果等文件，读者可以用Quartus II或相应的软件直接打开。设计源文件根据设计输入类型分为源代码或原理图等。-Each project examples include the project files of the project, source files, report files and generate the results files, the reader can use Quartus II or the sof
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[VHDL编程] Example-b8-4

说明：每个工程示例都包括了该工程的项目文件、源文件、报告文件和生成结果等文件，读者可以用Quartus II或相应的软件直接打开。设计源文件根据设计输入类型分为源代码或原理图等。-Each project examples include the project files of the project, source files, report files and generate the results files, the reader can use Quartus II or the sof
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[VHDL编程] Example-b8-5

说明：每个工程示例都包括了该工程的项目文件、源文件、报告文件和生成结果等文件，读者可以用Quartus II或相应的软件直接打开。设计源文件根据设计输入类型分为源代码或原理图等。-Each project examples include the project files of the project, source files, report files and generate the results files, the reader can use Quartus II or the sof
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[VHDL编程] quartusandmodelsim

说明：本文档对quartus与modelsim运用操作描述十分详细，对初学者，会有很大帮助！-Quartus and modelsim this document on the use of operations described in great detail, for beginners, there will be a great help!
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[VHDL编程] logic

说明：Verilog descr iption for cell logic
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[VHDL编程] C_Based_System_Level_Design

说明：SYSTEMC设计手册 C_Based_System_Level_Design-C_Based_System_Level_Design
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[VHDL编程] class_intro

说明：Xilinx培训资 包括相关软件的使用方法等~ ies-xilinx
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[VHDL编程] edk

说明：EDK, 文件说明 EDK使用方法 etc-edk
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