[VHDL编程] xmtr

说明：运用VHDL语言，实现串口的发送子程序，可以将该模块直接套入主程序。-VHDL UART SEND
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[VHDL编程] Recv

说明：运用VHDL语言，实现串口的接收子程序，可以将该子模块加载到主程序中。-VHDL UART RECEIVE
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[VHDL编程] AntGlitch

说明：运用VHDL语言，实现脉冲采集的滤波子程序，利用打两拍进行毛刺滤波，可以将该子模块加载到主程序中。-The use of the VHDL language, to achieve the the pulse collected filtering subroutine utilize playing two beats glitch filtering, the sub module is loaded into the main program.
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[VHDL编程] baud_gen

说明：运用VHDL语言，实现串口收发程序中的波特率设置的子程序，可以将该子模块加载到主程序中。-VHDL language, set the baud rate of the serial transceiver subroutine, this sub-module is loaded into the main program.
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[VHDL编程] switch

说明：运用VHDL语言，实现MAX7317的采集程序，可以将该子模块加载到主程序中。-The use of VHDL language the MAX7317' s acquisition program, this sub-module is loaded into the main program.
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[VHDL编程] adc

说明：实现模数转换功能,采样频率为时钟频率的36分之1，可以双路同时采样，并且串行输出，输出数据14位有符号数。-The analog-to-digital conversion, the sampling frequency is 1/36 of the clock frequency, can be dual simultaneous sampling, as well as serial output, the output data 14 of the number of symbols.
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[VHDL编程] Msignal_text

说明：M序列发生器，长度可调，输出为有符号数，性能稳定。-M-sequence generator, adjustable length, the output for a number of symbols, and stable performance.
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[VHDL编程] signaltext

说明：信号检测，有模数转换芯片驱动，32点周期积分，判决门限2048-Signal detection, analog-to-digital conversion chip driver, 32-point cycle integral, decision threshold 2048
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[VHDL编程] BlockRam

说明：块状ram使用实例，实现深度和宽度可调的FIFO，buffer。-The block ram instance, depth and width adjustable FIFO, buffer.
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[VHDL编程] led7yima16

说明：7段显示译码器的驱动，显示16进制数值，进制可调。-7-segment display decoder driver, display the hexadecimal value hex adjustable.
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[VHDL编程] Nios_sram24

说明：自己的毕设代码。实现用SDRAM运行nios，同时用SRAM保存摄像头数据。中间利用fifo可以保存两帧图像-Own the complete set up code. SDRAM running nios, SRAM save camera data. Intermediate use of fifo can save the image of the two
<liuxiaolei> 在 2025-12-30 上传 | 大小：4.53mb | 下载：0

[VHDL编程] ALU_4bit

说明：4位ALU,有两个4位输入，4位输出实现逻辑运算和算术运算，逻辑与或非，加1，减1等等功能-4 ALU, logical and arithmetic operations
<周晓生> 在 2025-12-30 上传 | 大小：38kb | 下载：0