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[VHDL编程] PNgenerator
说明:This is a simple example of PNgenerator which use the clock signal inside the NEXYS3 board.This is basically a 8-bit PN number added by 256. The initial value cannot be all zeroes.<WPI> 在 2025-06-08 上传 | 大小:9kb | 下载:0
[VHDL编程] Binary_to_BCD_Converter
说明:This is a binary to BCD convert designed by using the “shift and add-3 algorithm”. The verilog code of basic cell add-3 is also included in this file.<WPI> 在 2025-06-08 上传 | 大小:9kb | 下载:0
[VHDL编程] seg7_driver
说明:verilog七段数码管驱动,显示内容可以自己更改。-verilog segment digital tube driver<毛昱枫> 在 2025-06-08 上传 | 大小:175kb | 下载:0
[VHDL编程] Basys2UserTest
说明:由digilent生产的basys2开发板用户测试程序VHDL版-Produced by the digilent basys2 development board user testing procedures VHDL version<毛昱枫> 在 2025-06-08 上传 | 大小:357kb | 下载:0
[VHDL编程] jpegencode_latest.tar
说明:fpga verilog 实现jpeg ip核编码器-fpga verilog forjpeg encode ipcore<wanghaiwei> 在 2025-06-08 上传 | 大小:204kb | 下载:0
[VHDL编程] ZRtech-CORE
说明:淘宝卖家ZRTECH核心板的程序与PDF说明-ZRTECH core board procedures and instructions PDF<cheng> 在 2025-06-08 上传 | 大小:5.87mb | 下载:0
[VHDL编程] shift_register8
说明:XilinxFPGA Verilog 8位的移位寄存器-XilinxFPGA Verilog 8-bit shift register<小波> 在 2025-06-08 上传 | 大小:224kb | 下载:0