[VHDL编程] dispselect

说明：verilog写的数字频率计的选择模块,用与显示的选择-written in Verilog digital frequency meter option module, used and display options
<chen> 在 2025-12-23 上传 | 大小：81kb | 下载：0

[VHDL编程] CHWCNTACORA

说明：VHDL编程语言设计，显示灯，显示VHDL字样。-VHDL programming language design, indicator lights, indicating the word VHDL.
<张永强> 在 2025-12-23 上传 | 大小：8kb | 下载：0

[VHDL编程] hdl

说明：这是用Verilog HDL写的可调占空比分频控制器，可以挂在Avalon总线上使用-This is written in Verilog HDL with adjustable duty cycle frequency controller, can be hung on the Avalon bus use
<阿明> 在 2025-12-23 上传 | 大小：5kb | 下载：0

[VHDL编程] DE2Project_restored

说明：一个完整的设计DE2_project,希望对大家有所帮助，谢谢ok-A complete design DE2_project, everyone would like to be helpful, thank you ok
<jiayue> 在 2025-12-23 上传 | 大小：18.79mb | 下载：0

[VHDL编程] dds

说明：基于VHDL+FPGA的DDS信号发生设计，已经通过调式-Based on VHDL+ FPGA design of the DDS signal has been through mode
<陈阳> 在 2025-12-23 上传 | 大小：547kb | 下载：0

[VHDL编程] EX

说明：Top module name : SHIFTER (File name : SHIFTER.v) 2. Input pins: SHIFT [3:0], IN [15:0], SIGN, RIGHT. 3. Output pins: OUT [15:0]. 4. Input signals generated from test pattern are latched in one cycle and are synchronized at clock rising edge.
<hugo> 在 2025-12-23 上传 | 大小：4kb | 下载：0

[VHDL编程] 1_LAB

说明：Top module name : SHIFTER (File name : SHIFTER.v) 2. Input pins: SHIFT [3:0], IN [15:0], SIGN, RIGHT. 3. Output pins: OUT [15:0]. 4. Input signals generated from test pattern are latched in one cycle and are synchronized at clock rising edge.
<hugo> 在 2025-12-23 上传 | 大小：5.84mb | 下载：0

[VHDL编程] MiniStep

说明：XC95144步进电机驱动器源码,采用verilog vhdl开发,个人原创-XC95144 stepper motor drive source, using verilog vhdl development, personal originality
<王明新> 在 2025-12-23 上传 | 大小：4.63mb | 下载：0

[VHDL编程] bintoBCD

说明：介绍了基于Altera 公司的CPLD 芯片FL EX10 K,以及利用VHDL 语言实现多位二进 制码转换成8421BCD 码的原理、设计思路和软件实现。-Introduction based on Altera
<焦扬> 在 2025-12-23 上传 | 大小：226kb | 下载：0

[VHDL编程] 8259

说明：8259中断控制器，参考网上的源码，但自己已经调通，并且应用在控制卡和通信卡上。-8259 interrupt controller, online reference source, but he had transferred Qualcomm, and applications in the control card and communication card.
<高超> 在 2025-12-23 上传 | 大小：179kb | 下载：0

[VHDL编程] VERILOGHDL

说明：this a book about the verilog-hdl design and circuit simulation and synthesize example
<管清宇> 在 2025-12-23 上传 | 大小：140kb | 下载：0

[VHDL编程] a8254

说明：自己编写的8254计数器／计时器，实现了所有的６种模式，和大家一起分享。-I have written 8254 counter/timer, realize all the six kinds of patterns, and the U.S. share.
<高超> 在 2025-12-23 上传 | 大小：4.66mb | 下载：0