文件名称:DIVCLK
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介绍说明－－下载内容均来自于网络，请自行研究使用
该程序是用VHDL语言实现的时钟分频程序，可以把高频时钟信号分成低频时钟信号，便于实际应用。-The program is the realization of VHDL language program the clock frequency, high frequency clock signal can be divided into low-frequency clock signal, to facilitate the practical application.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
DIVCLK
......\DIVCLK.sym
......\divclk.vhd
......\divclkctrl.acf
......\divclkctrl.fit
......\divclkctrl.gdf
......\divclkctrl.hex
......\divclkctrl.hif
......\divclkctrl.mmf
......\divclkctrl.ndb
......\divclkctrl.pin
......\divclkctrl.pof
......\divclkctrl.rpt
......\divclkctrl.snf
......\divclkctrl.sof
......\divclkctrl.ttf
......\lcdctrl.acf
......\lcdctrl.hif
......\lcdctrl.mmf
......\LIB.DLS
......\U2295292.DLS
......\U6457893.DLS
......\U8148198.DLS
......\DIVCLK.sym
......\divclk.vhd
......\divclkctrl.acf
......\divclkctrl.fit
......\divclkctrl.gdf
......\divclkctrl.hex
......\divclkctrl.hif
......\divclkctrl.mmf
......\divclkctrl.ndb
......\divclkctrl.pin
......\divclkctrl.pof
......\divclkctrl.rpt
......\divclkctrl.snf
......\divclkctrl.sof
......\divclkctrl.ttf
......\lcdctrl.acf
......\lcdctrl.hif
......\lcdctrl.mmf
......\LIB.DLS
......\U2295292.DLS
......\U6457893.DLS
......\U8148198.DLS