文件名称:RISC_CPU
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介绍说明－－下载内容均来自于网络，请自行研究使用
用FPGA编写的一个简单的cup,其中包含cup的基本部分，希望能对大家有意-Prepared by a simple FPGA' s Cup, which contains the basic part of the cup, I hope you can intentionally,,,,,,,,,
(系统自动生成,下载前可以参看下载内容)
下载文件列表
RISC_CPU
........\accum.v
........\accum.v.bak
........\addr_decode.v
........\adr.v
........\alu.v
........\alu.v.bak
........\clk_gen.asm.rpt
........\clk_gen.done
........\clk_gen.eda.rpt
........\clk_gen.fit.rpt
........\clk_gen.fit.smsg
........\clk_gen.fit.summary
........\clk_gen.flow.rpt
........\clk_gen.map.rpt
........\clk_gen.map.summary
........\clk_gen.pin
........\clk_gen.pof
........\clk_gen.qpf
........\clk_gen.qsf
........\clk_gen.qws
........\clk_gen.sof
........\clk_gen.tan.rpt
........\clk_gen.tan.summary
........\clk_gen.v
........\clk_gen.v.bak
........\clk_gen_nativelink_simulation.rpt
........\counter.v
........\counter.v.bak
........\cpu.v
........\cpu.v.bak
........\datactl.v
........\datactl.v.bak
........\db
........\..\clk_gen.ace_cmp.bpm
........\..\clk_gen.ace_cmp.cdb
........\..\clk_gen.ace_cmp.ecobp
........\..\clk_gen.ace_cmp.hdb
........\..\clk_gen.asm.qmsg
........\..\clk_gen.asm_labs.ddb
........\..\clk_gen.atom.rvd
........\..\clk_gen.atom_map.rvd
........\..\clk_gen.cbx.xml
........\..\clk_gen.cmp.bpm
........\..\clk_gen.cmp.cdb
........\..\clk_gen.cmp.ecobp
........\..\clk_gen.cmp.hdb
........\..\clk_gen.cmp.kpt
........\..\clk_gen.cmp.logdb
........\..\clk_gen.cmp.qrpt
........\..\clk_gen.cmp.rdb
........\..\clk_gen.cmp.tdb
........\..\clk_gen.cmp0.ddb
........\..\clk_gen.cmp2.ddb
........\..\clk_gen.cmp_merge.kpt
........\..\clk_gen.db_info
........\..\clk_gen.eco.cdb
........\..\clk_gen.eda.qmsg
........\..\clk_gen.fit.qmsg
........\..\clk_gen.hier_info
........\..\clk_gen.hif
........\..\clk_gen.lfp.cdb
........\..\clk_gen.lpc.html
........\..\clk_gen.lpc.rdb
........\..\clk_gen.lpc.txt
........\..\clk_gen.map.bpm
........\..\clk_gen.map.cdb
........\..\clk_gen.map.ecobp
........\..\clk_gen.map.hdb
........\..\clk_gen.map.kpt
........\..\clk_gen.map.logdb
........\..\clk_gen.map.qmsg
........\..\clk_gen.map_bb.cdb
........\..\clk_gen.map_bb.hdb
........\..\clk_gen.map_bb.logdb
........\..\clk_gen.pre_map.cdb
........\..\clk_gen.pre_map.hdb
........\..\clk_gen.rpp.qmsg
........\..\clk_gen.rtlv.hdb
........\..\clk_gen.rtlv_sg.cdb
........\..\clk_gen.rtlv_sg_swap.cdb
........\..\clk_gen.sgate.rvd
........\..\clk_gen.sgate_sm.rvd
........\..\clk_gen.sgdiff.cdb
........\..\clk_gen.sgdiff.hdb
........\..\clk_gen.sld_design_entry.sci
........\..\clk_gen.sld_design_entry_dsc.sci
........\..\clk_gen.smp_dump.txt
........\..\clk_gen.syn_hier_info
........\..\clk_gen.tan.qmsg
........\..\clk_gen.tis_db_list.ddb
........\..\clk_gen.tmw_info
........\..\clk_gen_global_asgn_op.abo
........\..\prev_cmp_clk_gen.asm.qmsg
........\..\prev_cmp_clk_gen.eda.qmsg
........\..\prev_cmp_clk_gen.fit.qmsg
........\..\prev_cmp_clk_gen.map.qmsg
........\..\prev_cmp_clk_gen.qmsg
........\..\prev_cmp_clk_gen.tan.qmsg
........\incremental_db