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介绍说明－－下载内容均来自于网络，请自行研究使用
verilog 实现的可逆计数器及4-7译码器，实现并行置数，加减计数功能
-verilog achieve reversible counter and 4-7 decoder, set the number of parallelism, subtraction counting function
-verilog achieve reversible counter and 4-7 decoder, set the number of parallelism, subtraction counting function
(系统自动生成,下载前可以参看下载内容)
下载文件列表
decode4_7.v
counter.v