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文件名称:seg_display

  • 所属分类：
  • 其他小程序
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2016-11-15
  • 文件大小：
  • 2kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 刘**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

verilog语言编程，通过编程实现伪随机码的产生，程序简单易懂，易上手，带测试平台文件-verilog language programming, programming produced by pseudo-random code, the program easy to understand, approachable, with a test-platform file
(系统自动生成,下载前可以参看下载内容)

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