文件名称:ethernet_verilog
- 所属分类：
- 微处理器(ARM/PowerPC等)
- 资源属性：
- [VHDL] [源码]
- 上传时间：
- 2012-11-26
- 文件大小：
- 77kb
- 下载次数：
- 0次
- 提 供 者：
- 张**
- 相关连接：
- 无
- 下载说明：
- 别用迅雷下载，失败请重下，重下不扣分！
介绍说明－－下载内容均来自于网络，请自行研究使用
这是一个很好的Verilog 编写的8位RISC CPU源码（可做为MCU），并且包括完整的C 语言的测试代码。-This is a very good preparation Verilog 8-bit RISC CPU source (available as MCU), and includes a complete C language test code.
相关搜索： verilog
CPU
RISC
cpu
8
cpu
verilog
Ethernet
risc
cpu
cpu
8
hdl
risc
code
vip
username
and
password
for
pudn
com
risc
verilog
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pudn
com
risc
verilog
(系统自动生成,下载前可以参看下载内容)
下载文件列表
eth_clockgen.v
eth_cop.v
eth_crc.v
eth_defines.v
eth_fifo.v
eth_maccontrol.v
eth_macstatus.v
eth_miim.v
eth_outputcontrol.v
eth_random.v
eth_receivecontrol.v
eth_register.v
eth_registers.v
eth_rxaddrcheck.v
eth_rxcounters.v
eth_rxethmac.v
eth_rxstatem.v
eth_shiftreg.v
eth_spram_256x32.v
eth_top.v
eth_transmitcontrol.v
eth_txcounters.v
eth_txethmac.v
eth_txstatem.v
eth_wishbone.v
timescale.v
eth_cop.v
eth_crc.v
eth_defines.v
eth_fifo.v
eth_maccontrol.v
eth_macstatus.v
eth_miim.v
eth_outputcontrol.v
eth_random.v
eth_receivecontrol.v
eth_register.v
eth_registers.v
eth_rxaddrcheck.v
eth_rxcounters.v
eth_rxethmac.v
eth_rxstatem.v
eth_shiftreg.v
eth_spram_256x32.v
eth_top.v
eth_transmitcontrol.v
eth_txcounters.v
eth_txethmac.v
eth_txstatem.v
eth_wishbone.v
timescale.v