文件名称:verilogsourcefiles

  • 所属分类:
  • 其他嵌入式/单片机内容
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 19kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 张**
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介绍说明--下载内容均来自于网络,请自行研究使用

该代码中有不少关于学习verilog HDL的例子,对初学者有帮助-The code has a lot on learning verilog HDL examples have help for beginners
相关搜索: verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

source files

............\8bits_multiplier.v

............\8bits_multiplier.v.bak

............\8shift_register.v

............\8shift_register.v.bak

............\about_time.v

............\adder_test.v

............\arith_test.v

............\audio_dac.v

............\bit_test.v

............\clk_counter.v

............\clk_counter.v.bak

............\clk_counter_test.v

............\clk_counter_test.v.bak

............\clk_gen.v

............\clk_gen.v.bak

............\clk_gen1.v

............\clk_gen1.v.bak

............\connect_test.v

............\counter.v

............\counter.v.bak

............\counter1.v

............\counter1.v.bak

............\demo_multiout_function.v

............\demo_multiout_function.v.bak

............\dff.bak

............\dff_asychronous.v

............\equal_test.v

............\ex1.v

............\ex1.v.bak

............\ex2.v

............\ex2.v.bak

............\ex3.v

............\ex3.v.bak

............\ex4.v

............\ex4.v.bak

............\fff1.v

............\fff2.v

............\fff2.v.bak

............\full_adder_1.v

............\full_adder_1.v.bak

............\half_adder.v

............\left_shifter_4.v

............\left_shifter_4.v.bak

............\level_and_edge_sensitive_compare.v

............\level_and_edge_sensitive_compare.v.bak

............\logical_test.v

............\mux4_1.v

............\mux4_1.v.bak

............\mux_2_1.v

............\mux_2_1.v.bak

............\mytest.v

............\mytest.v.bak

............\my_carry.v

............\my_carry.v.bak

............\my_dff.v

............\my_dff.v.bak

............\my_sum.v

............\random_function.v

............\random_function.v.bak

............\read_mem.v.bak

............\reduct_test.v

............\register_initialize.v

............\register_initialize.v.bak

............\relat_test.v

............\shift_register_3.v

............\shift_register_3.v.bak

............\shift_test.v

............\string.v

............\task_example.v

............\task_example.v.bak

............\testmemory.v

............\testmemory.v.bak

............\timing_control_inner_mode.v

............\timing_control_inner_mode.v.bak

............\traffic_lights.v

............\traffic_lights.v.bak

............\transcript

............\unknown.v

............\unknown.v.bak

............\_8bits_multiplier1.v

............\_8bits_multiplier1.v.bak

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