文件名称:clock

  • 所属分类:
  • 其他小程序
  • 资源属性:
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 665kb
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本文档采用VHDL语言编写了一个数字时钟的程序,该数字时钟采用24小时制计时,可以实现整点报时,时间设置,闹钟等功能。最小分辨率为1秒。-VHDL language in this document using a digital clock to prepare the procedure, the digital clock 24-hour time system, you can bring the whole point of time, time settings, alarm clock functions. Minimum resolution of 1 second.
(系统自动生成,下载前可以参看下载内容)

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clock

.....\clk.vwf

.....\clock.asm.rpt

.....\clock.done

.....\clock.dpf

.....\clock.fit.rpt

.....\clock.fit.smsg

.....\clock.fit.summary

.....\clock.flow.rpt

.....\clock.map.rpt

.....\clock.map.summary

.....\clock.pin

.....\clock.pof

.....\clock.qpf

.....\clock.qsf

.....\clock.qws

.....\clock.sim.rpt

.....\clock.sof

.....\clock.tan.rpt

.....\clock.tan.summary

.....\clock.vhd

.....\clock.vhd.bak

.....\clock.vwf

.....\db

.....\..\clock.asm.qmsg

.....\..\clock.asm_labs.ddb

.....\..\clock.cbx.xml

.....\..\clock.cmp.bpm

.....\..\clock.cmp.cdb

.....\..\clock.cmp.ecobp

.....\..\clock.cmp.hdb

.....\..\clock.cmp.logdb

.....\..\clock.cmp.rdb

.....\..\clock.cmp.tdb

.....\..\clock.cmp0.ddb

.....\..\clock.db_info

.....\..\clock.eco.cdb

.....\..\clock.eds_overflow

.....\..\clock.fit.qmsg

.....\..\clock.hier_info

.....\..\clock.hif

.....\..\clock.map.bpm

.....\..\clock.map.cdb

.....\..\clock.map.ecobp

.....\..\clock.map.hdb

.....\..\clock.map.logdb

.....\..\clock.map.qmsg

.....\..\clock.map_bb.cdb

.....\..\clock.map_bb.hdb

.....\..\clock.map_bb.hdbx

.....\..\clock.map_bb.logdb

.....\..\clock.pre_map.cdb

.....\..\clock.pre_map.hdb

.....\..\clock.psp

.....\..\clock.root_partition.cmp.atm

.....\..\clock.root_partition.cmp.dfp

.....\..\clock.root_partition.cmp.hdbx

.....\..\clock.root_partition.cmp.logdb

.....\..\clock.root_partition.cmp.rcf

.....\..\clock.root_partition.map.atm

.....\..\clock.root_partition.map.hdbx

.....\..\clock.root_partition.map.info

.....\..\clock.rpp.qmsg

.....\..\clock.rtlv.hdb

.....\..\clock.rtlv_sg.cdb

.....\..\clock.rtlv_sg_swap.cdb

.....\..\clock.sgate.rvd

.....\..\clock.sgate_sm.rvd

.....\..\clock.sgdiff.cdb

.....\..\clock.sgdiff.hdb

.....\..\clock.signalprobe.cdb

.....\..\clock.sim.cvwf

.....\..\clock.sim.hdb

.....\..\clock.sim.qmsg

.....\..\clock.sim.rdb

.....\..\clock.sld_design_entry.sci

.....\..\clock.sld_design_entry_dsc.sci

.....\..\clock.syn_hier_info

.....\..\clock.tan.qmsg

.....\..\clock.tis_db_list.ddb

.....\..\clock.tmw_info

.....\..\prev_cmp_clock.asm.qmsg

.....\..\prev_cmp_clock.fit.qmsg

.....\..\prev_cmp_clock.map.qmsg

.....\..\prev_cmp_clock.qmsg

.....\..\prev_cmp_clock.sim.qmsg

.....\..\prev_cmp_clock.tan.qmsg

.....\..\wed.wsf

.....\Waveform1.vwf

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