文件名称:risc

  • 所属分类:
  • 微处理器(ARM/PowerPC等)
  • 资源属性:
  • [PDF]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 126kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 李*
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介绍说明--下载内容均来自于网络,请自行研究使用

嵌入式risc处理器源码,包含设计文档,原理图,testbench,及外围接口,使用verilog实现。-Source embedded RISC processors, including design documents, schematics, testbench, and peripheral interfaces, the use of Verilog to achieve.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

embedded_risc

.............\Machine_Language

.............\................\program.txt

.............\SOC_Design.pdf

.............\Test_Bench_Verilog

.............\..................\Top_level_tb.tf

.............\Verilog

.............\.......\ACC.V

.............\.......\ALU.V

.............\.......\bus_arbiter.v

.............\.......\cmd_ack.v

.............\.......\cmd_decoder.v

.............\.......\cmd_detector.v

.............\.......\cmd_generator.v

.............\.......\cmd_internal_reg.v

.............\.......\command_if.v

.............\.......\CONTROL.V

.............\.......\data_cache_way0.v

.............\.......\data_cache_way1.v

.............\.......\data_cache_way2.v

.............\.......\data_cache_way3.v

.............\.......\data_in_reg.v

.............\.......\data_port.v

.............\.......\dma_cntrl.v

.............\.......\dma_fifo.v

.............\.......\dma_internal_reg.v

.............\.......\flash_ctrl.v

.............\.......\fsm.v

.............\.......\instruction_cache_way0.v

.............\.......\instruction_cache_way1.v

.............\.......\instruction_cache_way2.v

.............\.......\instruction_cache_way3.v

.............\.......\IR.V

.............\.......\k9f1g08u0m.v

.............\.......\lru_data_cache.v

.............\.......\lru_instruction_cache.v

.............\.......\MEM.V

.............\.......\MUX12.V

.............\.......\MUX16.V

.............\.......\oe_generator.v

.............\.......\parameter.v

.............\.......\PC.V

.............\.......\ras_cas_delay.v

.............\.......\ref_ack.v

.............\.......\ref_timer.v

.............\.......\risc.v

.............\.......\sdram.v

.............\.......\sdramctrl_rtl.v

.............\.......\sdram_cntrl.v

.............\.......\sdram_mux.v

.............\.......\sdram_port.v

.............\.......\soc.v

.............\.......\timer.v

.............\.......\transcript

.............\.......\uart.v

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