文件名称:qdq_new

  • 所属分类:
  • 其它资源
  • 资源属性:
  • [WORD]
  • 上传时间:
  • 2008-10-13
  • 文件大小:
  • 64.03kb
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采用Verilog HDL设计,在掌宇智能开发板上得到实现

根据抢答器的原理,整个电路可划分为三部分:采样电路、门控电路和译码电路- Uses Verilog the HDL design, obtains the realization basis on
the palm space intelligence development board to snatch the answering
principle, the entire electric circuit may divide is three parts: The
sampling electric circuit, the gate control the electric circuit and
the decoding circuit
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qdq\decoder.acf
qdq\decoder.cnf
qdq\decoder.fit
qdq\decoder.hex
qdq\decoder.hif
qdq\decoder.mmf
qdq\decoder.ndb
qdq\decoder.pin
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qdq\decoder.sym
qdq\decoder.ttf
qdq\decoder.v
qdq\LIB.DLS
qdq\qdq(1).cnf
qdq\qdq.acf
qdq\qdq.cnf
qdq\qdq.fit
qdq\qdq.gdf
qdq\qdq.hex
qdq\qdq.hif
qdq\qdq.mmf
qdq\qdq.ndb
qdq\qdq.pin
qdq\qdq.pof
qdq\qdq.rpt
qdq\qdq.scf
qdq\qdq.snf
qdq\qdq.sof
qdq\qdq.ttf
qdq\U1593729.DLS
qdq\操作和引脚说明.doc
qdq

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