文件名称:ethernet_tri_mode

  • 所属分类:
  • Internet/网络编程
  • 资源属性:
  • [PDF]
  • 上传时间:
  • 2015-10-12
  • 文件大小:
  • 4.24mb
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FPGA 10M/100M/1000M以太网IP核源码,外接88e1111phy芯片进行了仿真验证,对FPGA 以太网MAC层开发人员非常有用-The FPGA 10 m/100 m/1000 m Ethernet IP core source code, an external 88 e1111phy chip simulation verification, is very useful for developers FPGA Ethernet MAC layer
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ethernet_tri_mode

.................\tags

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.................\....\........\...\RGMII_DataSheet.pdf

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.................\....\.......\bench

.................\....\.......\.....\verilog

.................\....\.......\.....\.......\Phy_sim.v

.................\....\.......\.....\.......\User_int_sim.v

.................\....\.......\.....\.......\altera_mf.v

.................\....\.......\.....\.......\host_sim.v

.................\....\.......\.....\.......\reg_int_sim.v

.................\....\.......\.....\.......\tb_top.v

.................\....\.......\doc

.................\....\.......\...\Tri-mode_Ethernet_MAC_Specifications.pdf

.................\....\.......\...\Tri-mode_Ethernet_MAC_Verification_plan.pdf

.................\....\.......\rtl

.................\....\.......\...\verilog

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.................\....\.......\...\.......\MAC_rx

.................\....\.......\...\.......\......\Broadcast_filter.v

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.................\....\.......\...\.......\......\MAC_rx_ctrl.v

.................\....\.......\...\.......\MAC_rx.v

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.................\....\.......\...\.......\MAC_tx

.................\....\.......\...\.......\......\CRC_gen.v

.................\....\.......\...\.......\......\MAC_tx_Ctrl.v

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.................\....\.......\...\.......\......\Ramdon_gen.v

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.................\....\.......\...\.......\RMON

.................\....\.......\...\.......\....\RMON_addr_gen.v

.................\....\.......\...\.......\....\RMON_ctrl.v

.................\....\.......\...\.......\....\RMON_dpram.v

.................\....\.......\...\.......\RMON.v

.................\....\.......\...\.......\TECH

.................\....\.......\...\.......\....\CLK_DIV2.v

.................\....\.......\...\.......\....\CLK_SWITCH.v

.................\....\.......\...\.......\....\duram.v

.................\....\.......\...\.......\eth_miim.v

.................\....\.......\...\.......\header.v

.................\....\.......\...\.......\miim

.................\....\.......\...\.......\....\eth_clockgen.v

.................\....\.......\...\.......\....\eth_outputcontrol.v

.................\....\.......\...\.......\....\eth_shiftreg.v

.................\....\.......\...\.......\....\timescale.v

.................\....\.......\...\.......\reg_int.v

.................\....\.......\sim

.................\....\.......\...\rtl_sim

.................\....\.......\...\.......\ncsim_sim

.................\....\.......\...\.......\.........\bin

.................\....\.......\...\.......\.........\...\cds.lib

.................\....\.......\...\.......\.........\...\com.nc

.................\....\.......\...\.......\.........\...\config.ini

.................\....\.......\...\.......\.........\...\hdl.var

.................\....\.......\...\.......\.........\...\ip_32W_check.dll

.................\....\.......\...\.......\.........\...\ip_32W_check_vpi.dll

.................\....\.......\...\.......\.........\...\ip_32W_gen.dll

.................\....\.......\...\.......\.........\...\ip_32W_gen_vpi.dll

.................\....\.......\...\.......\.........\...\sim.nc

.................\....\.......\...\.......\.........\...\sim_only.nc

.................\....\.......\...\.......\.........\...\vlog.list

.................\....\.......\...\.......\.........\data

.................\....\.......\...\.......\.........\....\1000Mbps_duplex.vec

.................\....\.......\...\.......\.........\....\100Mbps_duplex.vec

.........

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