文件名称:Register

  • 所属分类:
  • 其他小程序
  • 资源属性:
  • 上传时间:
  • 2018-01-11
  • 文件大小:
  • 367kb
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this code is by VHDL language for register ent counter register and
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VHDL

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TP2\VHDL_final\catas.tbw 634 2017-10-31
TP2\VHDL_final\catas.xwv 19720 2017-10-31
TP2\VHDL_final\decalage.ise 252934 2017-11-07
TP2\VHDL_final\decalage.ise_ISE_Backup 252934 2017-11-07
TP2\VHDL_final\decalage.restore 51565 2017-11-07
TP2\VHDL_final\isim\work\hdllib.ref 374 2017-11-03
TP2\VHDL_final\isim\work\hdpdeps.ref 991 2017-11-03
TP2\VHDL_final\isim\work\simu\mingw\testbench_arch.obj 24433 2017-11-03
TP2\VHDL_final\isim\work\simu\testbench_arch.h 1011 2017-11-03
TP2\VHDL_final\isim\work\simu\xsimtestbench_arch.cpp 2085 2017-11-03
TP2\VHDL_final\isim\work\sub00\vhpl00.vho 1024 2017-11-03
TP2\VHDL_final\isim\work\sub00\vhpl01.vho 3460 2017-11-03
TP2\VHDL_final\isim\work\sub00\vhpl02.vho 605 2017-11-03
TP2\VHDL_final\isim\work\sub00\vhpl03.vho 2868 2017-11-03
TP2\VHDL_final\isim\work\test\behavioral.h 966 2017-11-03
TP2\VHDL_final\isim\work\test\mingw\behavioral.obj 24385 2017-11-03
TP2\VHDL_final\isim\work\test\xsimbehavioral.cpp 1828 2017-11-03
TP2\VHDL_final\isim.cmd 14 2017-11-03
TP2\VHDL_final\isim.hdlsourcefiles 65 2017-11-03
TP2\VHDL_final\isim.log 981 2017-11-03
TP2\VHDL_final\isim.tmp_save\_1 497 2017-11-03
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TP2\VHDL_final\simu.ant 4197 2017-11-03
TP2\VHDL_final\simu.jhd 43 2017-11-03
TP2\VHDL_final\simu.tbw 633 2017-10-31
TP2\VHDL_final\simu.vhw 2540 2017-11-03
TP2\VHDL_final\simu.xwv 19940 2017-10-31
TP2\VHDL_final\simu.xwv_bak 19940 2017-11-03
TP2\VHDL_final\simulate_dofile.log 19 2017-11-03
TP2\VHDL_final\simulate_dofile.log_back 19 2017-11-03
TP2\VHDL_final\simu_beh.prj 44 2017-11-03
TP2\VHDL_final\simu_bencher.prj 22 2017-11-03
TP2\VHDL_final\simu_isim_beh.exe 569606 2017-11-03
TP2\VHDL_final\simu_isim_beh.wfs 496 2017-11-03
TP2\VHDL_final\test.vhd 1610 2017-11-03
TP2\VHDL_final\test_beh.prj 22 2017-11-03
TP2\VHDL_final\test_isim_beh.exe 465131 2017-11-03
TP2\VHDL_final\test_isim_beh.wfs 574 2017-11-03
TP2\VHDL_final\VHDLTP2.txt 1665 2017-10-31
TP2\VHDL_final\xilinxsim.ini 16 2017-11-03
TP2\VHDL_final\xst\work\hdllib.ref 170 2017-11-03
TP2\VHDL_final\xst\work\hdpdeps.ref 460 2017-11-03
TP2\VHDL_final\xst\work\sub00\vhpl00.vho 1004 2017-11-03
TP2\VHDL_final\xst\work\sub00\vhpl01.vho 3440 2017-11-03
TP2\VHDL_final\_xmsgs\fuse.xmsgs 369 2017-11-03
TP2\VHDL_final\_xmsgs\vhpcomp.xmsgs 1156 2017-11-03
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TP2\VHDL_final\isim\file graph 0 2017-11-03
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TP2\VHDL_final\_xmsgs 0 2017-11-03
TP2\VHDL_final 0 2018-01-10
TP2 0 2017-11-12

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