文件名称:UVM示例平台

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一个UVM完整组件的测试平台,以一个简单的路由器作为例子进行UVM测试(A test platform for UVM complete components, taking a simple router as an example for UVM testing.)
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UVM示例平台 0 2018-10-21
UVM示例平台\elaborate 0 2018-10-21
UVM示例平台\lab02_uvc 0 2018-10-21
UVM示例平台\lab02_uvc\sv 0 2018-10-21
UVM示例平台\lab02_uvc\sv\yapp_tx_seqs.sv 2503 2016-01-11
UVM示例平台\lab02_uvc\tb 0 2018-10-21
UVM示例平台\lab02_uvc\tb\top.sv 886 2015-05-28
UVM示例平台\lab11_regmodel 0 2018-10-21
UVM示例平台\lab11_regmodel\README.txt 831 2015-10-29
UVM示例平台\lab11_regmodel\apb 0 2018-10-21
UVM示例平台\lab11_regmodel\apb\.imc.trace 0 2015-05-28
UVM示例平台\lab11_regmodel\apb\PACKAGE_README.txt 1289 2015-05-28
UVM示例平台\lab11_regmodel\apb\demo.sh 2325 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv 0 2018-10-21
UVM示例平台\lab11_regmodel\apb\sv\apb_checker.sv 9517 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_collector.sv 5837 2015-05-28
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UVM示例平台\lab11_regmodel\apb\sv\apb_master_agent.sv 3611 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_master_driver.sv 25 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_master_driver_new.sv 6167 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_master_driver_orig.sv 6019 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_master_if.sv 3393 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_master_seq_lib.sv 7540 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_master_sequencer.sv 2099 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_monitor.sv 6463 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_pkg.sv 1675 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_slave_agent.sv 3878 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_slave_driver.sv 3552 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_slave_if.sv 2791 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_slave_seq_lib.sv 3987 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_slave_sequencer.sv 2150 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_transfer.sv 2090 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\apb_types.sv 1199 2015-05-28
UVM示例平台\lab11_regmodel\apb\sv\reg_to_apb_adapter.sv 2642 2015-05-28
UVM示例平台\lab11_regmodel\apb\tb 0 2018-10-21
UVM示例平台\lab11_regmodel\apb\tb\apb_demo_scoreboard.sv 4415 2015-05-28
UVM示例平台\lab11_regmodel\apb\tb\demo_config.sv 2224 2015-05-28
UVM示例平台\lab11_regmodel\apb\tb\demo_tb.sv 2435 2015-05-28
UVM示例平台\lab11_regmodel\apb\tb\demo_top.sv 1684 2015-05-28
UVM示例平台\lab11_regmodel\apb\tb\dut_dummy.v 105 2015-05-28
UVM示例平台\lab11_regmodel\apb\tb\seq_test.sv 842 2015-05-28
UVM示例平台\lab11_regmodel\apb\tb\sim_command.tcl 2206 2015-05-28
UVM示例平台\lab11_regmodel\apb\tb\test_lib.sv 5157 2015-05-28
UVM示例平台\lab11_regmodel\clock_and_reset 0 2018-10-21
UVM示例平台\lab11_regmodel\clock_and_reset\sv 0 2018-10-21
UVM示例平台\lab11_regmodel\clock_and_reset\sv\clock_and_reset.svh 425 2016-01-06
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UVM示例平台\lab11_regmodel\clock_and_reset\sv\clock_and_reset_low_if.sv 2015 2016-01-06
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UVM示例平台\router_rtl 0 2018-10-21
UVM示例平台\router_rtl\yapp_router.sv 46748 2015-05-28
UVM示例平台\spi_ps.v 66464 2013-11-06
UVM示例平台\spi_ps_processing_system7_0_wrapper.v 78758 2013-11-06

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