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  1. booth_mul

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  2. 一种可以完成16位有符号/无符号二进制数乘法的乘法器。该乘法器采用了改进的Booth算法,简化了部分积的符号扩展,采用Wallace树和超前进位加法器来进一步提高电路的运算速度。本乘法器可以作为嵌入式CPU内核的乘法单元,整个设计用VHDL语言实现。-a 16 to be completed with symbols / unsigned multiplication of the number of binary multiplier
  3. 所属分类:其它资源

    • 发布日期:2008-10-13
    • 文件大小:19758
    • 提供者:*
  1. booth_mul

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  2. 一种可以完成16位有符号/无符号二进制数乘法的乘法器。该乘法器采用了改进的Booth算法,简化了部分积的符号扩展,采用Wallace树和超前进位加法器来进一步提高电路的运算速度。本乘法器可以作为嵌入式CPU内核的乘法单元,整个设计用VHDL语言实现。-a 16 to be completed with symbols/unsigned multiplication of the number of binary multipliers.
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-09
    • 文件大小:19456
    • 提供者:*
  1. 95637012Multiplier

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  2. 一种可以完成16位有符号/无符号二进制数乘法的乘法器。该乘法器采用了改进的booth算法,简化了部分积的符号扩展,采用Wallace树和超前进位加法器来进一步提高电路的运算速度。本乘法器可以作为嵌入式CPU内核的乘法单元,整个设计用VHDL语言实现。- This file contains all the entity-architectures for a complete-- k-bit x k-bit Booth multipli
  3. 所属分类:数学计算/工程计算

    • 发布日期:2024-06-09
    • 文件大小:358400
    • 提供者:zhou
  1. Multiplier16

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  2. 本文设计了一种可以实现16位有符号/无符号二进制数乘法的乘法器。该乘法器采用了补码一位乘(Booth算法), 简化了部分积的数目, 减少了某些加法运算,从而提高了运算速度。该乘法器利用Verilog代码实现,通过Modelsim软件对相应的波形进行仿真验证,并通过QuartusII软件对源码进行编译综合。-This paper designed a 16 signed/unsigned binary number multiplicat
  3. 所属分类:VHDL编程

    • 发布日期:2024-06-09
    • 文件大小:5754880
    • 提供者:hxy
  1. 16 bit signed number multiplier

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  2. 16位有符号数乘法器,使用Booth编码和华莱士树,提供程序源文件和测试文件(The 16 bit signed multiplier uses Booth encoding and Wallace tree to provide source files and test files.)
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2024-06-09
    • 文件大小:6144
    • 提供者:Yongsen Wang

源码中国 www.ymcn.org