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  1. brentkung_adder

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  2. Synopsys的DesignWare库中采用的brentkung高速加法器Verilog源代码生成,附相关文档

  3. 所属分类：其它资源

    • 发布日期：2008-10-13
    • 文件大小：522368
    • 提供者：zx

  1. brentkung_adder

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  2. Synopsys的DesignWare库中采用的brentkung高速加法器Verilog源代码生成,附相关文档-Synopsys

  3. 所属分类：VHDL编程

    • 发布日期：2024-06-05
    • 文件大小：522240
    • 提供者：zx

  1. brentkung_32

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  2. 32 bit brentkung adder tr-32 bit brentkung adder tree

  3. 所属分类：VHDL编程

    • 发布日期：2024-06-05
    • 文件大小：1024
    • 提供者：suha

  1. brentkung_8

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  2. 8位的brentkung加法器树，在ISE环境下-8-bit brentkung adder tree, the ISE environment

  3. 所属分类：VHDL编程

    • 发布日期：2024-06-05
    • 文件大小：187392
    • 提供者：abby

  1. brentkung_16

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  2. 16位的brentkung加法器树，在xilinx软件下-16-bit brentkung adder tree, under the xilinx software

  3. 所属分类：VHDL编程

    • 发布日期：2024-06-05
    • 文件大小：411648
    • 提供者：abby

源码中国 www.ymcn.org