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  1. LPT

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  2. 实现开漏输出的并口，支持3.3V或5V，支持FPGA 的PS 配置功能。8位配置数据 自动移位输出，输入时钟24MHz，产生1MHz配置时钟。8位CPU数据总线接口， 11位地址总线。支持IO 的置位清除功能。-The realization of open-drain output of the parallel port, support 3.3V or 5V, support for FPGA configuration of the PS function. 8-bit conf

  3. 所属分类：VHDL编程

    • 发布日期：2025-07-06
    • 文件大小：2048

源码中国 www.ymcn.org