查看会员资料

用 户 名：许*

转帐 | 发送消息
  • Email：
    用户隐藏
  • Icq/MSN：
    qq
  • 电话号码：
  • Homepage：
  • 会员简介：
    这家伙很懒,什么都没留下!

最新会员发布资源

  1. dfilter

    0下载量：
  2. 用FPGA实现信道化接收机算法，共256个信道，处理时钟40M，时分复用完成算法实现-FPGA implementation using channelized receiver algorithm, a total of 256 channels, processing clock 40M, time division multiplexing algorithm to complete

  3. 所属分类：VHDL编程

    • 发布日期：2025-06-30
    • 文件大小：16457728

源码中国 www.ymcn.org