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  1. 091220111singalcpu

    0下载量：
  2. 用verilog HDL语言或者VHDL语言来编写，实现单周期CPU的设计。能够完成以下十六条指定： add rd, rs, rt addu rd, rs, rt addi rt, rs, imm addiu rt, rs, imm sub rd, rs, rt subu rd, rs, rt nor rd, rs, rt xori rt, rs, imm clo clz slt rd, rs, rt sltu rd, rs, rt slti

  3. 所属分类：VHDL编程

    • 发布日期：2025-06-28
    • 文件大小：9529344

源码中国 www.ymcn.org