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  2. H.264硬件视频解码，采用verilog代码设计，支持1.5M时钟下30bps的QCIF分辨率的实时视频解码-H. 264 hardware video decoder, use verilog code design, support under 1.5 M clock 30 BPS QCIF resolution of real-time video decoding

  3. 所属分类：VHDL编程

    • 发布日期：2025-06-13
    • 文件大小：16858112

源码中国 www.ymcn.org