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  1. axi_jesd204b

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  2. ADI JESD204接口的ADC与Xilinx FPGA接口IP，包含Verilog和VHDL源代码，AXI总线接口，ADC串行控制接口-ADI IP for interfacing JESD204 ADC to Xilinx FPGA, include Verilog/VHDL source code, AXI interface and serial config interface

  3. 所属分类：VHDL编程

    • 发布日期：2025-06-11
    • 文件大小：77824

源码中国 www.ymcn.org