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  1. clockVHDL

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  2. 利用VHDL语言设计的数字钟,能进行正常的时、分、秒计时功能，分别由6个数码管显示24h、60min、60s-The use of VHDL language design digital clock, can be a normal hour, minute, second timing function, respectively, by 6 digital tube display 24h, 60min, 60s

  3. 所属分类：VHDL编程

    • 发布日期：2025-07-14
    • 文件大小：146432

源码中国 www.ymcn.org