[VHDL编程] Counter60min

说明：VHDL语言编写的一个六十进制计数器（用于分钟），一个脉冲输入引脚，一个复位引脚，8个BCD码输出引脚，一个进位输出引脚。与我的其它8个模块配套构成一个数字钟。-A 60 binary counter(for minute) programmed with VHDL language.A pulse input, a reset input, eight BCD code output BCD code, a carry bit output. It is one of my total 9 m
<chzhsen> 在 2025-06-15 上传 | 大小：203kb | 下载：0

[单片机(51,AVR,MSP430等)] HSD2.8-R61526initcode

说明：HSD2.8寸Cell+瑞萨R61526初始化代码。-initial code
<hardy> 在 2025-06-15 上传 | 大小：1kb | 下载：0

[VHDL编程] Counter60sec

说明：VHDL语言编写的一个六十进制计数器(用于秒)，一个脉冲输入引脚，一个复位引脚，8个BCD码输出引脚，一个进位输出引脚。与我的其它8个模块配套构成一个数字钟。 -A 60 binary counter（for second） programmed with VHDL language.A pulse input, a reset input, eight BCD code output. It is one of my total 9 modules that are used to de
<chzhsen> 在 2025-06-15 上传 | 大小：144kb | 下载：0

[VHDL编程] Debounce

说明：VHDL编写。在CPLK开发板上设计的数字钟的去抖动电路。该模块相对独立，是学习去抖动的好资料。该模块跟我其它的8个模块配套构成一个数字钟。-Programmed with VHDL.A debouncing circuit which is part of a digital clock designed on a CPLD development board.The module is independent from others and is useful for learning de
<chzhsen> 在 2025-06-15 上传 | 大小：195kb | 下载：0

[VHDL编程] Displayer

说明：VHDL编写的针对八段数码管的显示译码电路。实现动态扫描输出小时、分钟和秒。是基于CPLD开发板设计的一个数字钟的一部分。-Programmed with VHDL.The decoding and displaying circuit for 8-segments displayer.It outputs the data of hour,minute and second in order with dynamic scaning method.It is one of my total 9
<chzhsen> 在 2025-06-15 上传 | 大小：147kb | 下载：0

[嵌入式/单片机编程] EEPROM-ATxmega256A3

说明：AVR1008: Writing EEPROM and Flash in ATxmega256A3 / ATxmega256A3B - Rev B
<igor/gavril> 在 2025-06-15 上传 | 大小：44kb | 下载：0

[VHDL编程] Distributer

说明：VHDL编写的分频器。用于将50MHz的时钟脉冲分频成一个500Hz的扫描时钟和1Hz的秒脉冲。与我的其它8个模块配套构成一个数字钟。-Programmed with VHDL.A clock distributer which generates a 500Hz scaning clock and a 1Hz second impulse. It is one of my total 9 modules that are used to design a digital clock.
<chzhsen> 在 2025-06-15 上传 | 大小：258kb | 下载：0

[单片机(51,AVR,MSP430等)] LM80C27

说明： DEVICE SPECIFICATION for Passive Matrix Color LCD Module (800 X 600 dots) Model No. LM8 O C 2 7 LM80C27.pdf
<igor/gavril> 在 2025-06-15 上传 | 大小：765kb | 下载：0

[VHDL编程] FlashTime

说明：用VHDL编写。称为校时闪烁电路。一般的电子表在校时时都会使被校正的时间不停地闪烁。此模块实现了类似的功能。与我的其它8个模块配套构成一个数字钟。 -Programmed with VHDL. It is called a flashing circuit(when time is being revised).Generally, a digital watch will flash the currently revised time(for example,hour) to let t
<chzhsen> 在 2025-06-15 上传 | 大小：140kb | 下载：0

[单片机(51,AVR,MSP430等)] 2_5GHz_dot_sourcecode

说明：Frequency Counter 2,5 GHz source code
<Mars> 在 2025-06-15 上传 | 大小：86kb | 下载：0

[VHDL编程] RvsTime

说明：用VHDL编写。数字钟校时电路，根据表示是否校时的输入引脚、是校正小时还是校正分钟的输入引脚决定校正状态。接受一个按钮的脉冲输入，每输入一个脉冲，被校正的时间增加1.与我的其它8个模块配套构成一个数字钟。-Programmed with VHDL.The time-revising circuit of a digital clock. Detect the inputs and decide if revise time, hour or minute. It recepts an impul
<chzhsen> 在 2025-06-15 上传 | 大小：116kb | 下载：0

[VHDL编程] ADigCLK

说明：用VHDL编写的一个数字钟。该模块是顶层模块，用VHDL例化语句例化各个子模块并组装成一个完整的数字钟。与我的其它8个模块配套构成一个数字钟。 -A digital clock programmed with VHDL.This module is the top-level module, it utilizes the Component instantiation of VHDL to incorporate all submodules into a complete digital
<chzhsen> 在 2025-06-15 上传 | 大小：505kb | 下载：0