[VHDL编程] Fenpin

说明：基于VHDL语言时钟晶振48Mhz的分频器的制作能够实现1HZ分频的时钟信号。-48Mhz clock oscillator based on VHDL language to achieve the production of crossover frequency of the clock signal 1HZ.
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[VHDL编程] Jshuqi

说明：基于VHDL原理图实现的计数器 时钟晶振为48MHZ -Schematic-based VHDL implementation of the counter clock oscillator is 48MHZ
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[VHDL编程] 1122

说明：已经成功的FPGA 控制的SDRAM控制器代码.只要修改你需要的宽度-FPGA has been successfully controlled by SDRAM controller code. As long as you need to modify the width of
<yangyang> 在 2025-06-05 上传 | 大小：188kb | 下载：0

[VHDL编程] 0011

说明：Altera_Sdram_IP_源码 可以参考的-Altera_Sdram_IP_ source for reference
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[VHDL编程] Qdaqi

说明：基于VHDL语言 实现八路抢答器 有源时钟48mhz 功能为任意按键按下屏蔽其它按键输入-VHDL language based on the active clock 48mhz eight Responder function to any button is pressed the other key input screen
<张帝> 在 2025-06-05 上传 | 大小：281kb | 下载：0

[VHDL编程] 3344

说明：BulkIn是FPGA向CY7C68013发送数据 BulkOut是FPGA从CY7C68013接收数据-BulkIn is the FPGA to send data to the CY7C68013 CY7C68013 BulkOut is receiving data from the FPGA
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[VHDL编程] 5566

说明：Alter官方FFT程序(使用Verilog编写)-Alter official FFT program (written using Verilog)
<yangyang> 在 2025-06-05 上传 | 大小：973kb | 下载：0

[VHDL编程] xuanze4x1

说明：基于VHDL语言 4选1 多路选择器 时钟48Mhz 功能4个输入只能有一个输出-Based on VHDL, 4 to 1 MUX clock 48Mhz features 4 inputs can be only one output
<张帝> 在 2025-06-05 上传 | 大小：141kb | 下载：0

[VHDL编程] 7788

说明：用verilog编写的1024点的fft快速傅立叶变换-Written in 1024 by verilog point fast Fourier transform fft
<yangyang> 在 2025-06-05 上传 | 大小：12kb | 下载：0

[VHDL编程] 99000

说明：VerilogHDL课件 学习的好资料 可以参考-VerilogHDL Courseware good information can refer to
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[嵌入式Linux] motion_detectionv1.0_1023

说明：网络摄像头和硬盘录像机专用芯片gm8180代码-Web camera and DVR-specific code chip gm8180
<xwj> 在 2025-06-05 上传 | 大小：470kb | 下载：0

[单片机(51,AVR,MSP430等)] EM78P468-NTC-lcd

说明：EM78P468 NTC lcd测温全套(C语言源代码)-EM78P468 NTC lcd full set temperature (C language source code)
<jjw> 在 2025-06-05 上传 | 大小：16kb | 下载：0