[DSP编程] TL5147_LCD_2CH

说明：用LCD显示采集到的图像，适用于DSP平台CCS软件，5147视频采集模块-LCD display to collect images
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[单片机(51,AVR,MSP430等)] CC2530-anjiankongzhiliushuideng

说明：CC2530 按键控制流水灯实验 附件文档说明-CC2530 button control light water experiments annex documentation
<胡> 在 2025-06-22 上传 | 大小：229kb | 下载：0

[单片机(51,AVR,MSP430等)] CC2530zhongduankongzhiLSD

说明：CC2530 外部中断控制流水灯 附件说明文档-CC2530 external interrupt control water lights annex documentation
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[单片机(51,AVR,MSP430等)] zigbee-stack-kongzhideng

说明：协议栈工作流程和无线收发控制LED 附件文档说明-Stack workflow and radio control LED Accessories documentation
<胡> 在 2025-06-22 上传 | 大小：28.26mb | 下载：0

[单片机(51,AVR,MSP430等)] zigbee-stack-touchuan

说明：12.串口透传之节点相互收发信息 附件文档说明-12. Serial node transparent transmission of information to send and receive attachments documentation
<胡> 在 2025-06-22 上传 | 大小：16.61mb | 下载：0

[硬件设计] chengxu

说明：硬件课程设计——交通管理系统设计（实测有效）-Hardware curriculum design- Traffic Management System (Found Effective)
<WXY> 在 2025-06-22 上传 | 大小：4kb | 下载：0

[VHDL编程] PS2_ctrl

说明：（1）对输入的时钟进行分频，得到190Hz 和25Hz 时钟信号，提供给其它模块作为时 钟输入； （2）键盘扫描模块：接收键盘的输入PS2C 和PS2D，并得到键盘扫描码xkey(15:0)； （3）数码管显示电路：将键盘扫描模块输出的扫描码显示在七段数码管。-(1) the input clock frequency division, get 190Hz and 25Hz clock signal, provided to other modules as the time
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[嵌入式/单片机编程] chengxu

说明：计算机控制课程设计——保温箱温度控制（实测有效）-Computer Control Curriculum design- incubator temperature control (measurement valid)
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[VHDL编程] VGA_disp

说明：clk divid 模块为分频电路，对50MHz 系统时钟进行分频产生50M/7Hz 的像素时钟。VGA control 模块为VGA 显示控制电路模块，在像素时钟的驱动下首先产生行频信号，而后对行频信号进行分频产生58Hz 场频信号。由于VS 与HS 信号具有严格的时序匹配，即VS 信号必须为HS 信号的整数倍，以保证在场频信号有效期间，能够完整数行的扫描，本设计利用对行频信号进行计数分频来产生场频信号。-Clk divid module for the frequency circuit,
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[VHDL编程] traffic-light

说明：（1） Divid 模块：1Hz 分频模块，开发板提供50MHz 的系统时钟，而该设计交通灯 转换以秒为计时单位，对50MHz 分频得到1Hz 脉冲信号。 （2） Divid_200 模块: 200Hz 分频模块,用于产生动态扫描模块的时钟。一个数码管 稳定显示要求的切换频率要大于50Hz，那么4 个数码管则需要50×4＝200Hz 以上 的切换频率才能看到不闪烁并且持续稳定显示的字符，因而扫描频率设定为 200Hz。 （3） Control 模块：A、B 方向红绿灯控制
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[VHDL编程] sin_en

说明：DDS 由相位增量器，相位累加器，量化器以及正余弦查找表四部分组成。 相位累加器每一周期会累加上固定的相位值，然后从查找表中找到对应的数值。-DDS by the phase increment, phase accumulator, quantizer and sine and cosine lookup table of four parts. The phase accumulator accumulates a fixed phase value for each period,
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[VHDL编程] clock

说明：用VHDL 语言设计数字钟，实现在数码管上显示分钟和秒，并且可以手动调节分钟， 实现分钟的增或者减。该设计包括以下几个部分： （1）分频电路的设计，产生1Hz 的时钟信号，作为秒计时脉冲； （2）手动调节电路，包括“时增”“时减”“分增”“分减”。 （3）时分秒计时电路。 （4）7 段数码管显示电路。 将 SW1 和SW2 初始状态均置为高电平。拨动开关SW1 到低，分钟进行加计数，秒停 止计数，当计数到59 时，从00 开始重新加计数，将SW1 拨动到高时，在当前状
<panda> 在 2025-06-22 上传 | 大小：484kb | 下载：0