[VHDL编程] xinhaoyuan

说明：DDS产生多种波形信号发生器，包括正弦波，三角波，方波，锯齿波。运行于Altera Cyclone FPGA平台。-DDS signal generator generates a variety of waveforms including sine, triangle wave, square wave, sawtooth wave. Running on Altera Cyclone FPGA platform.
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[VHDL编程] 2fsk_0516

说明：运行于Altera Cyclone FPGA平台,基于DDS原理的FSK信号发生器，可产生FSK信号-Running on Altera Cyclone FPGA platform, based on the principle of DDS FSK signal generator for FSK signal
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[VHDL编程] MOTO3--bujin

说明：运行于Altera Cyclone FPGA平台,顶层为原理图方式，模块由VHDL编写的步进电机驱动程序。-Running on Altera Cyclone FPGA platform, the top of the schematic way, module consists of VHDL stepper motor driver.
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[VHDL编程] MOTO3--zhiliu

说明：运行于Altera Cyclone FPGA平台,顶层为原理图方式，模块由VHDL编写的直流电机驱动程序。-Running on Altera Cyclone FPGA platform, the top of the schematic way, the module VHDL prepared by the DC motor driver.
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[VHDL编程] cmi

说明：运行于Altera Cyclone FPGA平台,由VHDL编写的NRZ到CMI编码和CMI到NRZ解码程序。-Running on Altera Cyclone FPGA platform, VHDL prepared NRZ to CMI CMI to NRZ encoding and decoding procedures.
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[VHDL编程] Manchester

说明：运行于Altera Cyclone FPGA平台,由VHDL编写的NRZ到曼彻斯特编码和曼彻斯特编码到NRZ解码程序。-Running on Altera Cyclone FPGA platform, consisting in VHDL coding NRZ to Manchester and Manchester encoding to NRZ decoding process.
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[VHDL编程] FPGA-verlog-SRAM

说明：FPGA verlog SRAM -FPGA verlog SRAM aaaaaaaaaaaaaaaaaaaaa
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[VHDL编程] zdsylj

说明：自动售饮料机，在quartusII平台上实现verilog源代码。很好用。-Beverage vending machine, quartusII platform to achieve verilog source code. Good use.
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[VHDL编程] fpga-iic

说明：基于FPGA的模拟IIC接口设计与实现，FPGA及片上系统SOPC应用 。-FPGA-based simulation IIC interface design and implementation, FPGA and SOPC System on Chip Applications
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[VHDL编程] vga

说明：vga，视频显示源代码，很好用，自己在板子上看看，我用了成功了。-vga, video display source code, very good, and their look on the board, I used a success.
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[VHDL编程] sdram

说明：sdram的quartusii实验源代码，和大家分享。很好用，我在自己的开发板上实现了他的功能，大家试一下。-sdram of quartusii experiment source code, and share. Very good, in my own development board realize his function, we try.
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[VHDL编程] rs232

说明：rs232串口通信实验4位的串口，verilog源代码。-rs232 serial communication experiment 4 serial, verilog source code
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