[VHDL编程] Frequce

说明：能测量频率，并且能测占空比10 90 ，还能产生1M 占空比10 的脉冲波- 能测量频率，并且能测占空比10 90 ，还能产生1M 占空比10 的脉冲波 Can measure the frequency, and can measure the duty cycle 10 90 , but also can produce the 1M duty cycle 10 of the pulse wave
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[VHDL编程] ExperimentoCap9

说明：Question cpa 9 of the an book in portuguese
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[VHDL编程] VGAController

说明：Easy VGAController in vhdl
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[VHDL编程] 8a

说明：2 Flip Flops in VHDL
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[VHDL编程] soma_loka

说明：Sum make in vhdl code
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[VHDL编程] rs_232

说明：Comunication rs232 in vhdl
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[VHDL编程] equalizer

说明：This the code for the channel equalizer and the test bench for this in the verilog code.-This is the code for the channel equalizer and the test bench for this in the verilog code.
<rion> 在 2025-06-24 上传 | 大小：1kb | 下载：0

[VHDL编程] convolution

说明：This the code for the convolutional and the test bench for this in the verilog code.-This is the code for the convolutional and the test bench for this in the verilog code.
<rion> 在 2025-06-24 上传 | 大小：1kb | 下载：0

[VHDL编程] demapperSharp1(16QAM)

说明：This the code for the demapper in the verilog code.-This is the code for the demapper in the verilog code.
<rion> 在 2025-06-24 上传 | 大小：1kb | 下载：0

[VHDL编程] inter_deleaver

说明：This the code for the interleaver and the deinterleaver in the verilog code.-This is the code for the interleaver and the deinterleaver in the verilog code.
<rion> 在 2025-06-24 上传 | 大小：2kb | 下载：0

[VHDL编程] mapperSharp1(16QAM)

说明：This the code for the mapper in the verilog code.-This is the code for the mapper in the verilog code.
<rion> 在 2025-06-24 上传 | 大小：1kb | 下载：0

[VHDL编程] mt9d112_ddr2

说明：镁光MT9基于FPGA图像采集模块，该模块可同时采集两路视频信号。其包括完整的时序和接口、ddr2内存数据写入和存储、qsys系统的搭建、FPGA与NIOS II联合设计-Micron MT9 based on FPGA image acquisition module, the module can simultaneously capture two video signals. Including the complete timing and interface, ddr2 memory
<豪> 在 2025-06-24 上传 | 大小：37.39mb | 下载：0