[VHDL编程] exercicio4

说明：VHDL program. Calculator that do basic operations. Add, subtract, divide and multiplication using Cyclone -VHDL program. Calculator that do basic operations. Add, subtract, divide and multiplication using Cyclone II
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[VHDL编程] HexatoSSD

说明：VHDL program. It s a converter from Hex to SSD format using Cyclone -VHDL program. It s a converter from Hex to SSD format using Cyclone II
<Ferdinando> 在 2025-06-09 上传 | 大小：346kb | 下载：0

[VHDL编程] TrafficLightController

说明：It s a vhdl program. Simulates a traffic light controllet using a Cyclone II FPGA
<Ferdinando> 在 2025-06-09 上传 | 大小：411kb | 下载：0

[VHDL编程] UserDefinedFunction

说明：It s a VHDL program. The program does a generic gray. Using a Cyclone II FPGA Board.
<Ferdinando> 在 2025-06-09 上传 | 大小：237kb | 下载：0

[VHDL编程] speed_measure_on_7_segment

说明：Period method of frequency measuring (change constant to speed measure). DE2 Board Quartus project. Input signal on GPIO, result on 7seg, start/stop with key[0].
<shaitan> 在 2025-06-09 上传 | 大小：40kb | 下载：0

[VHDL编程] comp

说明：数值比较器，Verilog实现，带具体实验说明文档。-Numerical comparator, Verilog realization of experiments with specific documentation.
<mypudn0001> 在 2025-06-09 上传 | 大小：738kb | 下载：0

[VHDL编程] my_code

说明：编码器和译码器，Verilog实现，有具体实验说明文档。-Encoder and decoder, Verilog realization of a specific experiment documentation.
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[VHDL编程] CLanguageProgrammingForTheDevelopmentOfThoseGuidel

说明：本文举例说明了如何用软件实现脉宽调制(PWM)，如何将该设计转换成一个可以在FPGA中运行的逻辑块，并能利用存储器映射I/O接口通过软件完成对该逻辑块的控制。- the paper illustrates how to use software pulse width modulation (PWM), how can the design into a run in the FPGA logic blocks, and can use memory mapped I/O Interface c
<susuwen> 在 2025-06-09 上传 | 大小：133kb | 下载：0

[VHDL编程] DSB3

说明：利用ISE软件编写的Verilog程序，可以进行信号的双边带调制-Using ISE software program written in Verilog, can be bilateral with a modulation signal
<蜡笔> 在 2025-06-09 上传 | 大小：920kb | 下载：0

[VHDL编程] MyDDS

说明：利用查找表法编写的DDS的verilog程序，节省了利用IP核实现需要的资源，软件为ISE，-Prepared using look-up table method of verilog DDS program, save the use of IP core implementation requires resources, software for the ISE,
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[VHDL编程] Walsh

说明：利用ISE编写的产生WALSH码的verilog程序，简单易懂，稍稍修改就可以产生出自己想的8 16 32 64位的WALSH码-Prepared using ISE verilog code generated WALSH procedures, easy to understand, a little modification can generate their own like the 8,16，32，64-bit code WALSH. .
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[VHDL编程] Average

说明：利用ISE软件编写的求平均数的verilog程序，可以用来求平均数，用来对信号幅度的平均值进行计算-ISE software written request using the average of the verilog program can be used to seek the average used to calculate the average amplitude of the signal
<蜡笔> 在 2025-06-09 上传 | 大小：189kb | 下载：0