[VHDL编程] caitiao

说明：QuartusII软件写的四条竖彩条信号，通过ADV7171芯片转成模拟信号在监视屏上显示。-The color bar signal which are writen by VHDL ，with the data of the signal converted to analog signal by ADV7171 ，are showed on TV monitor .
<丁会> 在 2025-06-08 上传 | 大小：4.44mb | 下载：0

[VHDL编程] blank

说明：监控摄像头传入数据，通过芯片TVP5150转换成数字信号，其中sav_check.vhd检测帧头，converter.vhd将信号转换成Y，Cb，Cr格式，最后write_blank.vhd重新组建完整数字信号，最后通过ADV7171转成模拟信号输出到监视器上。这中间，可以对Y做各种图像处理，如滤波处理，均衡处理，只需要在converter之后添加处理文件即可。-Surveillance camera incoming data through the chip TVP5150 converte
<丁会> 在 2025-06-08 上传 | 大小：6.28mb | 下载：0

[VHDL编程] behaviour_lot

说明：lot of program in the behaviour model using vhdl languag that will help for othres
<Dhiraj Gajbhiye> 在 2025-06-08 上传 | 大小：163kb | 下载：0

[VHDL编程] uart16750_latest.tar

说明：UART Module VHDL CODE TESTED ON FPGA
<dave> 在 2025-06-08 上传 | 大小：134kb | 下载：0

[VHDL编程] fsk

说明：使用quartus13.0 搭建的FSK调制解调仿真系统使用了DDS技术和正交相关解调。-Quartus13.0 built using FSK modulation and demodulation simulation system uses DDS technology and quadrature coherent demodulation.
<Dxm> 在 2025-06-08 上传 | 大小：14.58mb | 下载：0

[VHDL编程] pulse_gen

说明：Pulse generator using VHDL for most of FPGAs
<Mehran> 在 2025-06-08 上传 | 大小：1kb | 下载：0

[VHDL编程] waveform

说明：The waveform of pulse generator code
<Mehran> 在 2025-06-08 上传 | 大小：1kb | 下载：0

[VHDL编程] control

说明：The Pipeline SPIN model using VHDL
<Mehran> 在 2025-06-08 上传 | 大小：1kb | 下载：0

[VHDL编程] execute

说明：The pipeline SPIN VHDL code (execute part)
<Mehran> 在 2025-06-08 上传 | 大小：1kb | 下载：0

[VHDL编程] TimeClock

说明：能够在max3上显示24小时，并且具有定时功能，能够设定闹钟，具有正点报时-Max3 can display 24 hours, and has a timer function, be able to set the alarm, with punctual timekeeping
<段军> 在 2025-06-08 上传 | 大小：4.83mb | 下载：0

[VHDL编程] fetch

说明：The pipeline SPIN VHDL code (fetch part)
<Mehran> 在 2025-06-08 上传 | 大小：1kb | 下载：0

[VHDL编程] memory

说明：The pipeline SPIN VHDL code (memory part)
<Mehran> 在 2025-06-08 上传 | 大小：1kb | 下载：0