[VHDL编程] DE2_LCM_Num

说明：基於DE2系統的LCM verilog code,在LCM右下方顯示數字,每按一次按鍵數字會加1,顏色也會改變-Based on the DE2 System LCM verilog code, in the lower right corner shows the number of LCM, every time key figures will be one color may also be changed
<Emuil> 在 2025-12-24 上传 | 大小：1.04mb | 下载：0

[VHDL编程] DIV_CLK

说明：除頻code,只要修改數字並接上時脈,即可得到所要的頻率-In addition to the frequency code, as long as the modified digital clock connect, you can get to the frequency of
<Emuil> 在 2025-12-24 上传 | 大小：96kb | 下载：0

[VHDL编程] trueif

说明：一个超前进位加法器（及其testbench) .v文件-A CLA (and its testbench). V file
<QU YIFAN> 在 2025-12-24 上传 | 大小：1kb | 下载：0

[VHDL编程] verilog

说明：一个桶形移位寄存器的.v文件，含testbench-Shift Registers a bucket. V file containing Testbench
<QU YIFAN> 在 2025-12-24 上传 | 大小：1kb | 下载：0

[VHDL编程] verilog

说明：一个简单状态机的.v文件，含testbench-A simple state machine. V file containing Testbench
<QU YIFAN> 在 2025-12-24 上传 | 大小：1kb | 下载：0

[VHDL编程] add_overflow

说明：一个带overflow功能的加法器的实现，采用Matlab+Simulink-A band adder overflow function realization using Matlab+ Simulink
<QU YIFAN> 在 2025-12-24 上传 | 大小：9kb | 下载：0

[VHDL编程] add_rounding

说明：一个基于Matlab+Simulink的带Rounding功能的加法器实现-Based on Matlab+ Simulink with Rounding adder functions realize
<QU YIFAN> 在 2025-12-24 上传 | 大小：9kb | 下载：0

[VHDL编程] complex_add

说明：一个基于Matlab+Simulink的复数加法器实现-Based on Matlab+ Simulink plural adder realize
<QU YIFAN> 在 2025-12-24 上传 | 大小：8kb | 下载：0

[VHDL编程] vhdl

说明：非常经典的verlog hdl 语言学习教程及开发程序开发事例-Very classic verlog hdl Language Learning Course and development of procedures for the development of case
<> 在 2025-12-24 上传 | 大小：3.02mb | 下载：0

[VHDL编程] Verilog

说明：Verilog编程规范，好东西大家一起分享，一起学习-Verilog programming norms, good things with everyone sharing, learning together
<wanwenqing> 在 2025-12-24 上传 | 大小：71kb | 下载：0

[VHDL编程] flowadd

说明：两个浮点数相加的加法器，使用verilog编写-Addition of two floating-point adder, the use of Verilog to prepare
<蔡大> 在 2025-12-24 上传 | 大小：1kb | 下载：0

[VHDL编程] sin

说明：基于Quartus II 5.0编写的正弦波发生器，可控频率，用vhdl编写的-Quartus II 5.0 on the preparation of the sine wave generator, controllable frequency, prepared using VHDL
<uuk> 在 2025-12-24 上传 | 大小：464kb | 下载：0