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[VHDL编程sync(shipintongbuxinhao)

说明:基于QuartusII环境下以模块化的形式做成的视频复合同步信号。-QuartusII-based environment to create the form of modular composite video sync signal.
<邵捷> 在 2025-06-10 上传 | 大小:397kb | 下载:0

[VHDL编程soc-gr0040-010309

说明:xsoc vhdl verilog risc cpu soc implementation in very liitle cpld or fpga
<urga turg> 在 2025-06-10 上传 | 大小:397kb | 下载:0

[VHDL编程lcd_driver

说明:用FPGA控制12864液晶输出时钟信息 很好 可以根据自己的需要更改 -12864 LCD control with FPGA clock output information can be very good according to their need to change the
<刘军鹏> 在 2025-06-10 上传 | 大小:397kb | 下载:0

[VHDL编程ADC0809

说明:完整ADC0809的时序,采用VHDL语言编写,在Altera cycloneI/II系列下的EP1C6\EP2C5\8平台下测试完成,稳定-ADC0809 Driver by VHDL
<ziyan> 在 2025-06-10 上传 | 大小:397kb | 下载:0

[VHDL编程vhdlLCD1602

说明:用CPLD控制1602显示汉字,内含三个模块-1602 with the CPLD control display Chinese characters, contains three modules
<soisit> 在 2025-06-10 上传 | 大小:397kb | 下载:0

[VHDL编程xinhaofashengqi

说明: 信号发生器.来个时钟就在显示在led -xinhaofashengqi
<syh> 在 2025-06-10 上传 | 大小:397kb | 下载:0

[VHDL编程led

说明:VHDL用语言所写的液晶屏驱动程序,文本为word-VHDL
<li> 在 2025-06-10 上传 | 大小:397kb | 下载:0

[VHDL编程X-Romdrivers

说明:Drivers for X-Rom for using with GBA.
<ubk> 在 2025-06-10 上传 | 大小:397kb | 下载:0

[VHDL编程DPSK

说明:DPSK调制信号的生成,通过MATLAB生成测试数据,用quartusII软件编译并仿真-DPSK signal
<舒占军> 在 2025-06-10 上传 | 大小:396kb | 下载:0

[VHDL编程music_ic

说明:此為VHDL之音樂IC設計,透過Max Plus II將設計結果顯示。-This is the music of IC design VHDL, designed by Max Plus II results will be displayed.
<> 在 2025-06-10 上传 | 大小:396kb | 下载:0

[VHDL编程1602LCD_Verilog

说明:1602 显示的Verilog程序源码 很容易理解-Verilog 1602 display program source code is easy to understand
<changrenhe> 在 2025-06-10 上传 | 大小:396kb | 下载:0

[VHDL编程不用IP核设计乘法器

说明:VerilogHDL语言实现 不用IP核设计乘法器。(VerilogHDL language, do not use IP core design multiplier.)
<朱朱8 > 在 2025-06-10 上传 | 大小:396kb | 下载:0
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