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[VHDL编程] VHDLDesignMethodnew
说明：用VHDL语言实现可编程数字系统设计.该文档说明了VHDL的设计方法,设计单元,举了大量有价值的实例,给出了VHDL的代码.-VHDL language with programmable digital system design. This document describes the VHDL design method, design unit, cited an example of a large number of valuable, given the VHDL code.<ma fengxian> 在 2025-07-15 上传 | 大小：575kb | 下载：0
[VHDL编程] ps2_complex
说明：基于verilog的PS口控制程序，比较经典的代码。非常简单-The PS-based verilog port control procedures, more classic code. Very simple. .<洪依> 在 2025-07-15 上传 | 大小：575kb | 下载：0
[VHDL编程] ece5742010hw9CPU
说明：用verilog语言实现CPU， 其中包括几个不同的模块，每个模块中间由总线进行连接-implement the CPU using Verilog language, including the memory, controller,data path, the logic unit.<宫勋> 在 2025-07-15 上传 | 大小：575kb | 下载：0
[VHDL编程] DDS-Technology
说明：DDS Technology DDS技术与原理-DDS Technology<李洪胜> 在 2025-07-15 上传 | 大小：575kb | 下载：0
[VHDL编程] verilog-uart-rs232
说明：verilog HDL 描写的uart程序 由PC端接收然后+1返回 等等 东南大学09级4系综合课程设计-verilog HDL descr iption uart program Received by the PC side and then+1 back。 SEU..<yu> 在 2025-07-15 上传 | 大小：575kb | 下载：0
[VHDL编程] alarm
说明：VHDL，多功能数字钟：具有年、月、日、时、分、秒计数显示功能，以24小时循环计数；具有整点报时功能；可以对年、月、日、时、分及秒进行单独校对，使其校正到标准时间-VHDL, multifunction digital clock: a year, month, day, hour, minute, seconds count display features a 24-hour cycle The whole point timekeeping function possible for<yaonan> 在 2025-07-15 上传 | 大小：576kb | 下载：0
[VHDL编程] Digital_Clock1
说明：基于Basys2多功能数字钟 verilog HDL 完整工程文件-Based Basys2 multifunction digital clock verilog HDL complete project file<> 在 2025-07-15 上传 | 大小：575kb | 下载：0
[VHDL编程] calc_16_01_14
说明：A VHDL code for a simple calculator.It reads the operator and operands form the memory and execute<Prasad.M> 在 2025-07-15 上传 | 大小：576kb | 下载：0
[VHDL编程] XPS_Custom_IP_Tutorial_3
说明：Custom IP Core Development tutorial in Xilinx XPS Part 3<numteh > 在 2025-07-15 上传 | 大小：576kb | 下载：0