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[VHDL编程] veriloghdl
说明:来自精益求精的德国人讲授的VERILOG课件,想接触FPGA/CPLD开发的人是必看的课件。<王方> 在 2025-06-11 上传 | 大小:4.72mb | 下载:0
[VHDL编程] PIPE_LINING_CPU_TEAM_24
说明: 采用Quatus II编译环境,使用Verilog HDL语言编写实现了五段流水线CPU。 能够完成以下二十二条指令(均不考虑虚拟地址和Cache,并且默认为小端方式): add rd,rs,rt addu rd,rs,rt addi rt,rs,imm addiu rt,rs,imm sub rd,rs,rt subu rd,rs,rt nor rd,rs,rt xori rt,rs,imm clo rd,rs clz rd,rs slt rd,rs,rt sltu rd,<石> 在 2025-06-11 上传 | 大小:4.72mb | 下载:0
[VHDL编程] VerilogHDLxiayuwen
说明:Verilog HDL数字设计与综合 夏宇闻译(第二版)-Digital design and synthesis of Verilog HDL translation of Xia Yu Wen (Second Edition)<liuxuhui> 在 2025-06-11 上传 | 大小:4.71mb | 下载:0
[VHDL编程] sdram_sv
说明:sdram在quartus下的VerilogHDL描述,准确的是SystemVerilog,已调试成功,不过还没利用突发传输功能,内含modulesim的仿真文件。-sdram VerilogHDL under the quartus descr iption is accurate SystemVerilog, has been commissioning successful, but not using burst transmission, the simulation file con<Anthony> 在 2025-06-11 上传 | 大小:4.72mb | 下载:0
[VHDL编程] iic_v1.0_for_sim
说明:程序用于配置ad9883a芯片寄存器,采用iic协议,可以写入后再通过串口输出,方便调试。-The program used to configure ad9883a chip registers, the iic agreement, you can write and then output through the serial port, to facilitate debugging.<徐宏亮> 在 2025-06-11 上传 | 大小:4.71mb | 下载:0
[VHDL编程] cronometro
说明:cronometer with counter updown and decoder with preescaler 100to1<mat> 在 2025-06-11 上传 | 大小:4.72mb | 下载:0
[VHDL编程] DDR_sdram
说明:文件里有DDR3/DDR4 sram的verliog模型,而且具有DDR4参考书(The document has a verliog model of DDR3/DDR4 SRAM, and it has DDR4 reference books.)<maxw123456789> 在 2025-06-11 上传 | 大小:4.71mb | 下载:0